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数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 33 |主题: 31156|排名: 8 

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公告: 大附件建议上传在云盘,然后分享链接(可以自行设定下载积分) jackzhang 2025-1-14    
隐藏置顶帖 按网友需求,收集的ISSCC 2008~2025 资料汇总  ...23456..234 jackzhang 2024-11-29 233086692 ssy020504 9 分钟前
隐藏置顶帖 工业电子元器件物料在线查询下载  ...23456 jackzhang 2024-6-3 5252710 lani09 2025-8-20 16:26
隐藏置顶帖 请不要上传TSMC的工艺库等资料,这个属于侵权行为,请不要再上传了  ...23 jackzhang 2013-11-29 2637260 onepound 前天 05:05
隐藏置顶帖 重奖500积分!下载《芯片设计软硬件接口(HSI)描述语言等SoC设计资料》  ...23456..18 jackzhang 2025-7-8 17931161 hwlyic 2025-10-2 14:49
隐藏置顶帖 活动推荐(奖励1200信元):IDAS 2025设计自动化产业峰会(9月15-16日,杭州)  ...23456..12 论坛管理员-1 2025-8-22 1155984 GGuoDDong 半小时前
隐藏置顶帖 万元大奖!PyAether【开放题目应答、自由作品征集、研究成果互认】征集全面开启! 精华1  ...2 PyAether玩家 2025-7-12 113844 zhangshiwei 3 天前
      
Yuki_IC2024-12-159929zhh1242025-5-20 21:53
vhdl实现DES算法  ...23 du139123456789 2008-4-17 23782685 风释怀 2017-11-23 14:09
i2c协议  ...234 atuhappy 2003-11-2 39259043 石头111 2020-5-11 11:51
[统计] 你是用VHDL还是用Verilog HDL?  ...23456..89 buley 2011-9-8 888235912 dennisi123 昨天 17:52
[原创] cadence IUS9.2 ncverilog安装方法,环境设置,原创。  ...23456..87 lsqswl 2011-12-4 860201153 colindeng 2024-9-19 12:43
[原创] 两个剧牛的数字电路——异步时钟切换和倍频 精华3  ...23456..35 wice3 2007-1-25 344159962 lazawei 2023-10-26 15:39
[原创] 个人写的DDR3的工作原理,欢迎大家拍砖! 精华1  ...23456..47 dzplay 2015-5-23 466154547 Jimoas 2025-7-18 18:34
[原创] low power RTL 设计优化 精华3  ...23456..34 yaya126 2017-9-9 333154216 puppyzhou2011 2025-8-27 11:26
[求助] 该学哪门语言?SystemVerilog VS SystemC  ...23456..26 albe2t 2011-11-22 260147534 871370416 2025-9-2 14:59
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[讨论] 自己写的DDR2控制器(含PHY)在FPGA上跑到1066了【27楼更新手动PR/时钟树介绍】 精华3  ...23456..24 Timme 2012-8-10 239133553 芯星 2021-6-7 20:26
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