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楼主: yaya126

[原创] low power RTL 设计优化

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发表于 2017-10-30 10:28:13 | 显示全部楼层
回复 3# yaya126


    你好,请问line9不拿掉不会keep 吗?有点不理解,之前一直都是推荐将条件写完整,就是不变也要写上line9的?
   

   1 always@(posedge clk or negedge rstn) begin

     2     if(!rstn)begin

     3         Q<= 'h0;

     4     end

     5     else if (condition_1)begin

     6         Q<= D_1;

     7     //other condition 2, 3, 4 …

8     else begin

     9         Q<= Q;  //better to remove this assignment, then data willbe kept.

    10     end

发表于 2017-10-30 12:08:32 | 显示全部楼层
写得很好,不知道有没有研究过glitch power 的问题
发表于 2017-10-30 12:19:27 | 显示全部楼层
写的不错,学习学习!
发表于 2017-11-1 10:57:03 | 显示全部楼层
学些了,特别脚本。谢谢大牛。
发表于 2017-11-15 15:45:26 | 显示全部楼层
楼主辛苦了
发表于 2017-11-26 22:01:35 | 显示全部楼层
帖子不错值得学习,多谢分享!
发表于 2017-11-28 12:37:11 | 显示全部楼层
感謝樓主分享!
发表于 2017-11-28 13:25:52 | 显示全部楼层
加精帖
发表于 2017-12-2 20:04:48 | 显示全部楼层
大佬再多点这样的干货~~感谢
发表于 2017-12-2 21:11:54 | 显示全部楼层
great summary
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