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数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 1 |主题: 31045|排名: 7 

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Yuki_IC2024-12-153869zhh1242025-5-20 21:53
投票 [调查] 你用cadence工具多还是synopsys工具多?  ...23456..10 netshell 2018-4-17 9854223 Lotusy 半小时前
[资料] Verilog高级数字系统设计技术与实例分析_(美)Kishore Mishra著_北京:电子工业出版社_2018.0... attach_img 魏凯 2022-9-1 92890 Menghua1998 1 小时前
投票 [讨论] 这样写代码是不是应该叉出去!  ...2 yangqi666 2024-10-6 177760 ldd-1987 2 小时前
投票 [求助] 该学哪门语言?SystemVerilog VS SystemC  ...23456..26 albe2t 2011-11-22 260144254 871370416 2 小时前
投票 [调查] 数字IC设计硕士年收入起薪调查,自2020年起~ attach_img  ...23456..8 杰克 2021-7-10 7157206 1326870639 9 小时前
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悬赏 [求助] synopsys的SSI IP中 XIP功能为什么不会发送Instruction - [悬赏 300 信元资产] New FIFO_empty 前天 17:01 4193 Carmelo 昨天 21:46
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