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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › 关于AHB总线verilog代码实现（design篇）
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楼主: hbhbts

[原创] 关于AHB总线verilog代码实现（design篇）

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pslinhu
发表于 2015-4-8 14:20:43 | 显示全部楼层
希望能贴出设计思想
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tide
发表于 2015-4-9 16:39:12 | 显示全部楼层
eetooooop
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silencefpga
发表于 2015-9-8 23:29:51 | 显示全部楼层
thank you for your sharing
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pppp1130
发表于 2015-9-22 01:28:57 | 显示全部楼层
好文，推推推
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whz7783478
发表于 2015-9-22 09:15:57 | 显示全部楼层
难得的资料！
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colin99
发表于 2015-9-24 10:18:31 | 显示全部楼层
顶一个，学习学习。
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hhy317460268
发表于 2015-12-29 15:01:28 | 显示全部楼层
谢谢分享
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mphorse
发表于 2016-3-16 22:50:28 | 显示全部楼层
不错，学习了
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weisen_wang
发表于 2016-3-17 11:20:48 | 显示全部楼层
顶起~~祝楼主开心~
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luei1987kg
发表于 2016-5-3 22:37:12 | 显示全部楼层
谢谢分享
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