在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
[求助] 基于FPGA中8051IP内核的数字电子钟的设计 易常居士 2015-5-11 42559 casejob 2024-11-16 21:03
数字IC/FPGA培训 paperfly 2008-9-13 84453 casejob 2024-11-16 20:41
[原创] 《FPGA数字电子系统设计与开发实例导航》刘韬 attachment  ...23456..8 liuliming808 2015-5-17 7321856 casejob 2024-11-16 19:42
[资料] 《FPGA_数字电子系统设计与开发实例导航》 attachment zxopenwgb 2016-9-19 94014 casejob 2024-11-16 17:00
[原创] Xcelium/Jaspergold License 新人帖 attach_img  ...23456..16 dogor1 2019-4-19 15353253 开发工具 2024-11-16 10:26
[求助] Verilog 模块复用求助 wjdb3 2024-11-13 5614 kk316 2024-11-16 00:38
[资料] 搜集的UPF资料 attachment 147107186s 2023-7-25 31426 hxy2018 2024-11-15 18:11
[求助] RTL 代码加扰,工具与思路? attach_img  ...2 wuzl423 2019-11-11 1717934 RS9110 2024-11-15 16:25
[原创] 不可忽视的verilog零延迟 attach_img jackiexiuyi 2018-3-15 76225 charleszh 2024-11-15 11:16
[资料] python硬件设计库MyHDL attachment  ...23456..18 iNostory 2017-12-7 17659961 吕归尘 2024-11-14 18:17
[资料] Cortex M0 IP (完整 Verilog Code) attach_img dodoee 2024-9-3 11670 Scriabing 2024-11-14 15:22
[求助] spyglass的sdc问题 ilmkduse 2024-11-4 4707 ilmkduse 2024-11-14 14:54
[原创] 数字典型电路知识结构地图,请大家参考,也希望积极补充! attach_img digest agree  ...23456..30 rosshardware 2018-9-4 297134674 Nouins 2024-11-14 13:43
[解决] 项目外包:用FPGA实现DP接口转eDP接口 attachment  ...2 fzfh1219 2020-5-25 168838 yuzhouyouling 2024-11-14 11:16
[转贴] 怎样预测FPGA开发板用到的逻辑单元的数目 新人帖 michaelwangwin 2024-11-14 1333 菜鸟要飞 2024-11-14 10:02
[解决] RedHat rhel 6.7 firefox 启动不了。报错: /usr/lib64/libxul.so: undefined symbol: PL_SizeOfArenaPoolExcludingPool 新人帖 zjmcc 2020-4-30 96722 purist 2024-11-14 09:50
[求助] 请教 一下XILINX 官方网站提供的ZYNQ zc702_Schematic 原理图 用什么软件打开啊 attachment  ...2 chenpenghjh3 2013-7-30 1412910 sensorsky 2024-11-13 20:16
[求助] synopsys里面的时钟约束怎么设置? orientview 2024-11-13 0281 orientview 2024-11-13 18:38
[求助] 用VCS仿真xilinx mig的example design 出错 古镜子 2016-7-29 54757 xxaw 2024-11-13 17:35
[讨论] max_capacitiance violation attach_img scutlee 2024-11-13 1370 Quinn714 2024-11-13 16:12
[资料] hdmi时序理解 attach_img 羽无芯 2021-1-19 06125 羽无芯 2024-11-13 15:36
[讨论] TL和TSL有什么区别?? scutlee 2024-11-13 0280 scutlee 2024-11-13 11:19
[讨论] FPGA综合用的资源特别少怎么办 scutlee 2024-11-7 3511 2596784844 2024-11-13 10:13
[讨论] 啥是out external delay attach_img scutlee 2024-11-11 4541 IcerVictor 2024-11-13 09:27
[讨论] 组合逻辑和时序逻辑 scutlee 2024-11-12 0323 scutlee 2024-11-12 15:38
悬赏 [求助] snapshot does not exit问题 - [悬赏 10 信元资产] janexuechan 2024-7-9 3822 午夜小河A 2024-11-12 13:38
[转贴] FPGA综合用的资源特别少怎么办 dzq312 2024-11-12 0339 dzq312 2024-11-12 13:06
悬赏 [求助] 求助Ubuntu 22.04 中 VCS 2018.09-SP2遇到undefined reference to `pthread_yield\'的错误 - [悬赏 60 信元资产]  ...23 中文行吗 2022-5-23 278522 CanBck 2024-11-12 10:24
[求助] deltasigma数字滤波器设计 attach_img kingdomzhen 2024-11-11 8835 kingdomzhen 2024-11-12 10:20
投票 [活动] 国产FPGA大家倾向使用哪家产品 574920045 2024-10-17 51345 574920045 2024-11-11 15:04
[求助] [求助] 求一个vivado 2018.3 的IEEE1735 v2 encryption license 新人帖 qq6853988 2024-7-25 3713 murphy522 2024-11-10 08:53
[讨论] IP资源互换 一个昵称 2024-11-9 0497 一个昵称 2024-11-9 10:17
[求助] VCS dve打开license报错 新人帖 yangmou 2024-11-8 2432 yangmou 2024-11-8 23:24
[求助] 如何使用脚本实现下述网表替换 jinfeier 2024-11-8 5508 acrofoxAgain 2024-11-8 21:44
[资料] 基于Spyglass的同步设计分析与静态验证 attachment  ...2345 edacw 2019-12-23 4214625 ffsher100 2024-11-8 21:17
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

小黑屋| 手机版| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-4-6 02:24 , Processed in 0.019466 second(s), 9 queries , Gzip On, MemCached On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块