faltten SDC对于前端来说怎么获得呢？

Bradji · 发表于 2022-6-19 10:56:20

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我们有个项目，项目里面的IP太多，采用了分模块综合，最后TOP层综合的时候，后端要求我们提供一下Faltten SDC，有哪位大神可以讲解一下这个Flatten sdc吗？对于前端来说应该怎么获得呢？

watertree · 发表于 2022-6-19 15:22:30

TOP综合还是TOP STA需要提供flatten sdc ？

Love24 · 发表于 2022-6-20 11:24:58

本帖最后由 Love24 于 2022-6-20 11:26 编辑

应该是顶层集成完之后，进行综合，DC生成的sdc文件

Bradji · 发表于 2022-6-21 11:36:38

watertree 发表于 2022-6-19 15:22
TOP综合还是TOP STA需要提供flatten sdc ？

TOP STA

Bradji · 发表于 2022-6-21 11:38:51

Love24 发表于 2022-6-20 11:24
应该是顶层集成完之后，进行综合，DC生成的sdc文件

假如我们有两个子模块，在顶层综合的时候是分别把这两个子模块写成DB文件后，DC吃进去的，顶层的SDC只针对了现有的代码进行了约束，对于子模块里面的文件没有约束，现在要对TOP 进行STA，整个顶层的FLATTEN SDC是不是要把这两个子模块的综合时候的约束SDC吃进去呢？我是这样理解的，请各位前辈赐教

watertree · 发表于 2022-6-21 11:43:41

Bradji 发表于 2022-6-21 11:38
假如我们有两个子模块，在顶层综合的时候是分别把这两个子模块写成DB文件后，DC吃进去的，顶层的SDC只针 ...

是这样。注意要修改对应的Hierarchy。因为TOP level看和 block level看，hierarchy不一样。

Love24 · 发表于 2022-6-21 17:26:21

本帖最后由 Love24 于 2022-6-21 17:53 编辑

你说的这种方式，其实就是把两个子模块先进行综合，生成.db或者.ddc文件，顶层综合的时候，不再从每一行RTL开始综合，而是直接把db文件放在DC的link library中，也就是把两个模块做成harden，这样顶层综合和STA时，你的约束只需要约束顶层就行，子模块内部都已经固化成具体的电路单元了，工具无法再去改变和优化子模块内部。

Bradji · 发表于 2022-6-22 09:14:55

本帖最后由 Bradji 于 2022-6-22 09:19 编辑

Love24 发表于 2022-6-21 17:26
你说的这种方式，其实就是把两个子模块先进行综合，生成.db或者.ddc文件，顶层综合的时候，不再从每一行RTL ...

请教您个问题，如果是要做TOP的FLATTEN的STA，是不是要让PT工具吃进去所有网表，不是吃对应子模块的DB文件，然后在写FLATTEN SDC时把之前两个子模块的对应SDC加到TOP的SDC里面，除了要修改hierarchy之外，是不是也要把子模块SDC里面对应 input delay output delay driving_cell set_load这类约束去掉呢？

Love24 · 发表于 2022-6-22 14:58:33

Bradji 发表于 2022-6-22 09:14
请教您个问题，如果是要做TOP的FLATTEN的STA，是不是要让PT工具吃进去所有网表，不是吃对应子模块的DB文件 ...

顶层的sdc中，不需要再加子模块的input/output delay以及set_driving_cell、set_load这些，因为这些约束都是针对port的，子模块单独综合时，其输入输出是port，集成到顶层后，其输入输出是pin，自然就不需要给子模块设置这些约束了；

Bradji · 发表于 2022-6-22 21:24:12

Love24 发表于 2022-6-22 14:58
顶层的sdc中，不需要再加子模块的input/output delay以及set_driving_cell、set_load这些，因为这些约束 ...

非常感谢

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