数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 31279|排名: 7

版主: yadog, everhappy, chevroletss, shiyinjita, chinafpga, dlb05061131, guofu2010, acgoal, neoitachi, arthur_wang_orz, tangyutao, wanghl_beijing, HADIST

1 ... 9 10 11 121314 15 16 17 ... 894 / 894 页下一页

新窗全部主题最新热门热帖精华更多		作者	回复/查看	最后发表


[原创] haps-64 ddr3 资料	dash_chenjh 2014-3-5	63883	bagshtag 2025-8-13 21:04
[资料] DDR3_JESD79-3E-译文 DDR3数据手册中文翻译	xf2016 2025-3-14	61256	bagshtag 2025-8-13 20:47
[转贴] I2C设计 ...2	gmei1981 2024-11-28	123013	bagshtag 2025-8-13 16:42
[求助] 求一份Spyglass CDC rule reference Guide。万分感谢 ...2 3 4	入迷 2022-8-19	3010832	bagshtag 2025-8-13 16:37
[资料] AMBA_3_AHB-Lite协议中文版 ...2 3 4	chnlw111 2018-3-11	3818030	bagshtag 2025-8-13 16:31
[资料] DDR phy接口协议 ...2 3 4 5 6..7	blackman00000 2017-1-9	6424753	bagshtag 2025-8-13 16:29
[求助] 关于spyglass的格雷码检查的问题	tjz1127 2025-8-8	4640	Challensys 2025-8-13 16:21
[原创] UART毕业设计（含中文论文和verilog源码） ...2	lbzhu 2020-6-26	116192	doing5552 2025-8-13 15:14
[求助] Cortex-M0 cortexm0ds_logic reset	fangyou123 2025-8-8	3650	Y__Y 2025-8-12 20:51
[求助] DFT综合时dft_drc命令报了S1违例，扫描链被阻塞，但后续ATPG正常，需要管DFT的违例吗	2441697316 2025-8-6	3536	2441697316 2025-8-12 15:07
[求助] 关于AD9361的多芯片同步的问题 - [已解决] ...2	TUJzzz 2023-8-1	128578	Andy126 2025-8-12 10:10
[求助] the register clock path is multi-driven ?	macherie 2022-7-29	42696	逐梦帅年 2025-8-11 18:29
[求助] 数字滤波器的架构设计系数设计是数字还是算法负责啊	alex_fd12 2025-8-9	2593	2596784844 2025-8-11 17:18
[资料] 跟我一起写makefile ...2 3	survivalmode 2020-12-2	209104	hot_hu 2025-8-11 15:11
[求助] lattice cpld时序约束100M的时候最大能跑到85m,但是约束80M的时候提示最大只能跑74M是	851018986 2025-8-1	1518	loglong 2025-8-11 14:44
[求助] AMBA AHB中Slave出现Error回应时，为什么要两个周期，回到IDLE状态是必要操作吗？	日晨难再 2025-7-14	91193	sme-ic 2025-8-11 09:15
[求助] 关于DFT中指定内部pin为scan mode的问题	EEDong 2025-8-9	1583	蕾兹曼 2025-8-11 08:56
[原创] Mbist在RTL和netlist插入的区别？？？ ...2 3	yepizhou 2010-4-15	2117216	grace-luo 2025-8-10 10:56
[求助] 能从fir的传递函数直接看出是高通还是低通的吗	alex_fd12 2025-8-10	0441	alex_fd12 2025-8-10 10:05
[原创] Understanding the Basics and Beyond of SAR ADC ...2	loongik2010 2025-2-8	192143	qwqwasas1234 2025-8-9 14:12
[求助] 求 SPI口的EEPROM verilog model ...2	seuzhangle 2020-12-15	104241	sunil4u 2025-8-8 19:44
[求助] 异步复位如何穿过没有复位的数据路径？	EEDong 2025-8-4	7684	EEDong 2025-8-8 17:51
[讨论] 大家是怎么判断dc综合哪些是正常优化，哪些是把不该优化的优化掉了？	隔壁小吴 2025-8-8	3475	芯电图 2025-8-8 15:27
[求助] 除频电路时序问题 - [悬赏 100 信元资产]	xueyou9469 2025-3-4	31511	kilua516 2025-8-8 10:05
大家用什么画图工具？ ...2 3 4 5 6	ailone 2008-12-12	5728070	kilua516 2025-8-8 09:53
[求助] 求个文献 Lattice Basis Reduction: An Introduction to the LLL Algorithm and Its Applications - [已解决]	snq31418 2025-8-8	2571	snq31418 2025-8-8 09:40
[原创] RDMA over RoCE V2设计2：设计构思	xidianuser 2025-7-15	3881	xidianuser 2025-8-7 19:20
[求助] DFT中扫描链的插入而引入的测试端口是自己加上去的还是自动加上去的呢？ ...2 3 4	sages 2012-8-6	3322221	lvfinn 2025-8-7 15:40
[原创] SoC中的IO模块设计 pinpad design in soc ...2 3	sandyhan 2014-3-19	2915349	Lavender888 2025-8-7 09:50
[资料] FPGA笔试题及答案总结 ...2	zxopenwgb 2016-10-18	125954	andersondon 2025-8-6 10:53
[求助] LPDDR5X速率和频比的问题 - [悬赏 10 信元资产]	briantmali 2025-7-14	9999	444903935 2025-8-5 17:16
[求助] formality发现无法match	851018986 2025-8-5	2492	851018986 2025-8-5 16:14
[求助] snapshot does not exit问题 - [悬赏 10 信元资产]	janexuechan 2024-7-9	41781	潇湘剑客 2025-8-4 15:01
[讨论] 综合过程中，register有哪些情况会被优化掉？	DCraneee 2025-8-4	0445	DCraneee 2025-8-4 13:17
[原创] NVMe高速传输之摆脱XDMA设计25：UVM验证	xidianuser 2025-7-31	1591	xidianuser 2025-8-4 11:58

1 ... 9 10 11 121314 15 16 17 ... 894 / 894 页下一页

返回发新帖

账号		自动登录	找回密码
密码			注册

数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 31279|排名: 7

快速发帖

站长推荐 /2