数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 3 |主题: 31329|排名: 8

版主: yadog, everhappy, chevroletss, shiyinjita, chinafpga, dlb05061131, guofu2010, acgoal, neoitachi, arthur_wang_orz, tangyutao, wanghl_beijing, HADIST

1 ... 16 17 18 192021 22 23 24 ... 896 / 896 页下一页

新窗全部主题最新热门热帖精华更多		作者	回复/查看	最后发表


[求助] 运行DC 2012lab1时，报set_tlu_plus_files error,请教各位这个怎么解决？	mar 2020-12-18	33479	zhoutt 2025-6-22 00:06
[求助] Verdi中波形trace变化情况 - [悬赏 300 信元资产]	786797740 2025-6-16	3971	xiatianla 2025-6-20 20:15
[求助] ncprotect portview 加密后无端口	yanrenyi 2014-11-19	87390	wojffvgkb 2025-6-20 10:27
[求助] Vivado里面DDS ip核仿真相关问题	George_01 2025-6-19	1853	George_01 2025-6-19 21:26
[原创] 使用最少fpga资源实现JPEGXS编解码	guanzhzh 2025-6-19	0811	guanzhzh 2025-6-19 20:11
[资料] 网络是怎么连接的［书籍］	撒野 2024-12-9	71404	linggan2005 2025-6-19 17:27
[求助] dc综合使用dc_shell生成的网表有dw模块，使用dc_shell -topo生成的网表没有是为啥	851018986 2025-6-17	6888	日晨难再 2025-6-19 14:13
[原创] vcs仿真遇到的问题	atlandis 2015-12-4	44247	进击的阿姆 2025-6-19 10:28
[求助] DVE打不开	nullptr 2023-6-15	53021	jokeshe 2025-6-19 01:03
[原创] 《IEEE 1588v2.1-2019》 ...2	艾艾小阳 2021-9-28	115666	clslhy 2025-6-18 16:59
[原创] RDMA简介6之RoCE V2 连接管理	xidianuser 2025-6-13	1817	xidianuser 2025-6-18 11:45
[原创] sdfAnnotateInfo反标报告INTERCONNECT无法统计	dingdang0101 2025-6-16	1610	dingdang0101 2025-6-18 11:27
[求助] spyglass读取RTL代码时，对于设计中designware加密的iip如何处理？ ...2	CunjieSong 2020-10-27	1611900	shingang2001 2025-6-18 09:37
[其它] chisel的一些资料 ...2 3	quanqiutong 2020-1-4	2614886	ldd-1987 2025-6-18 09:21
[求助] tsmc N65库里面的crtmom的license key怎么查看？	调皮捣蛋 2023-2-25	83839	shuangwen 2025-6-17 22:35
[求助] .cshrc文件是干嘛的？ ...2 3	朱鹮2011 2015-8-3	2429983	naninina 2025-6-17 16:34
[求助] dc使用求助 ...2	shiluo9 2025-6-6	121428	shiluo9 2025-6-17 16:00
[求助] XA+VCS addr4仿真出现“Module or design unit `addr4' specified in ..."ERROR	zh17863817115 2024-7-2	21398	wx1999622 2025-6-17 11:18
[资料] Verilog数字VLSI设计教程 PDF+verilog源码 ...2 3 4 5 6..23	megaic 2016-4-22	22976011	skyzz80 2025-6-17 09:36
[原创] 高速数字设计	nuerhachidetian 2019-9-10	42865	tu_yjq123 2025-6-17 07:03
[原创] cadence vipcat	里里欧欧 2025-6-16	0873	里里欧欧 2025-6-16 17:18
[求助] 请教vc spyglass中将时钟接0的SETUP_CLOCK_CONSTANT错误该如何添加约束	rickchueng 2025-6-12	1736	csr605 2025-6-16 15:19
[转贴] New MentorKG EFA 13.6.15 - 2019, 2012, 2010, 2009, 2008 - Install all the Mentor products you need ...2 3 4 5 6..7	ricvadim 2020-3-8	6524158	carl_andrew 2025-6-15 15:22
[求助] 有偿求tsmc 5nm pdk的design compiler， icc配置	siriux 2024-10-7	41413	darkcorvus01 2025-6-14 21:31
[求助] DC 脚本检查方法 ...2	sukong123 2015-8-18	108496	Challensys 2025-6-14 11:24
[求助] 请问如何保证数模接口时许的正确性 ...2	flyskyseu 2024-12-27	142712	welco 2025-6-13 22:06
[求助] 帮下载一个candence视频 ...2	cowant 2025-6-11	171337	cowant 2025-6-13 15:11
[资料] DDR 里on the fly的一些解释	xf2016 2025-6-13	2994	xf2016 2025-6-13 14:48
[求助] 帮忙下载几篇IEEE的paper	kk2009 2025-6-12	2690	kk2009 2025-6-12 17:28
[求助] vc formal cc check求助 - [悬赏 100 信元资产]	ypyp 2025-4-8	1978	ypyp 2025-6-12 10:28
[求助] 问下关于formality的问题~~关于verify过程 ...2 3	lingqi0077 2010-10-14	2215342	Jason_Odysseus 2025-6-10 19:21
[求助] 深度讨论—tessent工具做ATPG以后进行后仿，定义的时钟始终为Z态，请教各位坛友如何解决	IC菜鸟无敌 2020-8-21	86961	badegg3 2025-6-10 16:33
[求助] 请教S家的D-PHY RX配置，为什么没办法进入STOP状态？	q1074213103 2025-6-10	0634	q1074213103 2025-6-10 11:33
[求助] 请问MIPI D-PHY 什么时候开始串转并，才能准确确认SOT所在的byte，再进行ERR判断？	q1074213103 2025-6-9	4894	q1074213103 2025-6-10 10:54
[求助] GF22FDX和GF12LPP前端面积折算	skysand 2025-6-10	0608	skysand 2025-6-10 10:17

1 ... 16 17 18 192021 22 23 24 ... 896 / 896 页下一页

返回发新帖

账号		自动登录	找回密码
密码			注册

数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 3 |主题: 31329|排名: 8

快速发帖

浏览过的版块

站长推荐 /1