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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子）› 数字IC设计【ASIC|IC前端|FPGA】› 数字IC设计讨论(IC前端|FPGA|ASIC)
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数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 30736|排名: 10 

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公告 公告: 大附件建议上传在云盘，然后分享链接（可以自行设定下载积分） jackzhang 2024-12-24    
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全局置顶 隐藏置顶帖 试用申请：想使用华大九天开专门的PyAether试用区的，快来排队预约吧 attach_img PyAether玩家 4 天前 0122 PyAether玩家 3 天前
      
Yuki_IC2024-12-14431Yuki_IC2024-12-2 17:14
投票 [统计] 你是用VHDL还是用Verilog HDL？  ...23456..89 buley 2011-9-8 885212822 叨叨江湖 2024-12-14 11:10
[原创] cadence IUS9.2 ncverilog安装方法，环境设置，原创。 attach_img  ...23456..87 lsqswl 2011-12-4 860181818 colindeng 2024-9-19 12:43
[原创] 个人写的DDR3的工作原理，欢迎大家拍砖！ attach_img digest  ...23456..47 dzplay 2015-5-23 463139010 542002990 2024-6-6 07:52
[原创] 明德扬资料大赠送----笔试面试必看FPGA视频  ...23456..33 mdykj33 2016-2-16 32938583 老姚1992 2017-2-20 20:29
[原创] IC前端设计絮论 attachment digest  ...23456..33 jackertja 2011-5-3 324111170 lmc15063013 2023-4-4 20:03
[原创] 工作10年的工程师的心得 digest  ...23456..60 dodoee 2009-11-12 598131880 EEbits 2024-8-20 13:52
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投票 [求助] 该学哪门语言？SystemVerilog VS SystemC  ...23456..26 albe2t 2011-11-22 258137934 download_n 2024-12-17 17:47
投票 [调查] 平时在工程设计中 Xilinx的FPGA 常用，还是使用 Altera的FPGA 常用？  ...23456..25 hongbutiao 2012-11-27 249111994 kl_upc 2024-11-15 11:52
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[原创] low power RTL 设计优化 attach_img digest  ...23456..32 yaya126 2017-9-9 319136115 nomercy 7 天前
[资料] soc设计流程详细指导书，包括VCS 、ICC、DC。 attachment  ...23456..22 nwpuwangxf 2015-10-26 21447939 wangzzhe 2024-3-1 11:03
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[活动] 《嵌入式软硬件协同设计实战指南：基于Xilinx ZYNQ》试读及ZED开发板线下体验活动 attachment  ...23456..15 qiang0204 2013-2-28 14658463 huatiantian 2022-2-21 20:01
[原创] 数字集成电路设计，我的梦 digest agree  ...23456..28 aidepei 2008-12-3 278121062 cq20 2021-12-2 21:31
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[原创] 关于AHB总线verilog代码实现（design篇） attachment digest  ...23456..20 hbhbts 2013-12-5 191101452 ych634227759 2024-9-27 14:56
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