在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜全文
[讨论] 问问大家,写verilog代码时候,是先把时序图画出来。还是边想边写?  ...2 cgssuccess 2013-9-23 1410452 hancheng1166 2013-10-15 01:34
[讨论] DDR3读写 Oboyer 2013-2-2 22371 yyyxgh 2013-10-14 22:26
[求助] 多倍抽取或者内插的FIR滤波器实现结构 sss08_leon 2013-10-14 03825 sss08_leon 2013-10-14 18:19
[求助] DC综合求指导(分层模块导入问题) aishan5945 2013-10-11 75601 aishan5945 2013-10-14 10:57
[求助]数字芯片反向设计的流程和工具 yuzhicai 2005-5-12 37064 zhang2000 2013-10-13 20:10
[求助] xilinx v7 中的高速收发器 chen851112 2013-9-30 84441 chen851112 2013-10-13 17:45
[原创] 关于处理谐波杂散的方法 kalwinlue000 2013-7-21 54972 kalwinlue000 2013-10-13 13:51
[求助] bin转换hex  ...2 lilyzhong 2013-10-10 109125 zhang2000 2013-10-12 20:56
关于modulesim得一个问题 licmos 2006-3-13 34063 979947803 2013-10-12 16:53
[原创] 请教读写clk相差很大的异步fifo如何clear呢?wr_clr和rd_clr如何处理? atlandis 2013-10-11 12961 xiaojigao 2013-10-12 14:08
[求助] DDR2使用求助 670687308 2013-10-9 14431 woodhorse 2013-10-12 13:48
[求助] microblzae sdk 中的函数的使用 574920045 2013-10-12 01562 574920045 2013-10-12 10:23
[求助] 跨时钟域的一个面试问题,求解答! prototyping 2013-10-11 33392 lhlhualin 2013-10-11 23:48
[求助] fgpa 如何实现inout 互联  ...2 puyuwei 2011-5-18 199867 barrypp 2013-10-11 23:25
[原创] 谁有 RobustVerilog parser wide_road 2013-10-11 03127 wide_road 2013-10-11 17:58
[求助] 关于fvtool的疑问 691564736 2013-10-10 23034 eagle654321 2013-10-11 16:29
[原创] {}拼接语法 aishan5945 2013-8-24 43597 aishan5945 2013-10-11 15:41
[求助] microblaze外部IP接口 574920045 2013-10-11 02014 574920045 2013-10-11 11:19
[求助] 求助:关于VHDL代码和signal tap抓波形不一致问题 ksqnhm 2013-10-10 12610 owen70080 2013-10-11 01:25
[求助] dc综合时能通过命令固定输入port的值吗? orlye 2013-10-8 74136 orlye 2013-10-10 20:26
[求助] 在synplify中综合完成的文件在Q2中的Place&Route问题 kskfrank 2013-10-10 03211 kskfrank 2013-10-10 19:12
[求助] verilog中四舍五入的问题 qiudanyi1 2013-9-26 47078 曦玄 2013-10-10 18:56
[求助] 关于使用Synplify综合已经建立的工程的一些问题 kskfrank 2013-10-8 43715 kskfrank 2013-10-10 17:47
[活动] 转让EP4CE30F23C8N芯片 easyma 2013-10-10 03278 easyma 2013-10-10 16:09
[求助] xilinx运用xps时的问题 451582319 2013-10-10 01896 451582319 2013-10-10 10:25
[求助] Verilog语言 lcw6021213 2013-10-9 12984 黄zhuoquan 2013-10-10 10:07
[原创] PCIe仿真问题 鲁翔 2012-8-16 24361 zhicc 2013-10-10 09:02
[求助] quartus ii 10.0在win7下运行 显示内存不足 hbbdlx 2013-10-9 24505 hllyh 2013-10-10 09:01
[求助] 关于除法器在状态机中的使用 eastwinter1 2013-10-8 63667 eastwinter1 2013-10-10 08:48
[求助] SDRAM控制器后仿真遇到问题,如图所示,求指点 arccosx 2013-3-18 83710 coyoo 2013-10-10 08:15
[求助] xilinx 多周期约束问题 leozh 2013-9-30 13386 acgoal 2013-10-10 08:14
[求助] 请教一个设计综合的最高频率与输入时钟频率的问题  ...2 qlengyu 2010-6-9 115061 xiaoyu608 2013-10-9 16:18
[讨论]请问用FPGA能实现MII接口吗?大概需要多少资源呢?  ...2 sie 2003-7-26 1510066 TA说他是 2013-10-9 11:30
[原创] 求帮助 FPGA 四输入和六输入查表法的性能 - [已解决]  ...2 飞翔的鱼儿 2013-9-28 1211789 greenwindstudio 2013-10-8 20:37
[讨论] 读使能(Read enable)信号的作用和目的是什么? ttxs2009 2013-10-2 35851 greenwindstudio 2013-10-8 20:29
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

X

手机版| 小黑屋| 关于我们| 联系我们| 用户协议&隐私声明| 版权投诉通道| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 ) |网站地图

GMT+8, 2025-12-24 01:26 , Processed in 0.058333 second(s), 7 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块