在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜帖子
[求助] DC综合,时钟源加入PAD之后延迟很大 新人帖 shirui11 2020-1-2 32334 shirui11 2020-1-2 21:31
[求助] t28工艺下,24位数乘13位数大概要多久 nm2012 2020-1-2 42067 吾要单片机 2020-1-2 19:16
[原创] 分享贴:刚完成的FPGA插值滤波器设计 精华3 chop147 2018-11-15 74369 我叫oi 2020-1-2 11:42
[讨论] 综合DRC之max transition违例的疑问 西门电工 2020-1-2 02562 西门电工 2020-1-2 11:35
[原创] quartus用M9K例化了两个RAM,为何使用比例为0? american007 2019-12-29 22480 american007 2020-1-1 16:40
[原创] ALTERA没有外部reset信号输入,内部如何产生? american007 2020-1-1 01832 american007 2020-1-1 16:38
[求助] rhel 4, Conformal thjan65 2019-12-30 22182 thjan65 2019-12-31 21:35
[求助] 关于XILINX ISE 10.1的问题 先来个小目标 2019-12-25 22041 zzj0329 2019-12-31 13:09
[求助] verilog循环移位的问题 zxpfrz@qq.com 2012-4-28 713586 fbliang 2019-12-30 16:10
[求助] DDR4 能报timing error 的model,谁有? 傲拓天疆 2019-12-10 11685 ht_lch 2019-12-29 23:41
[原创] 谁说 30多岁 精力 不抵刚毕业的新人的?  ...2 yangyanwen123 2016-8-19 156646 14425324 2019-12-29 22:42
[求助] Verdi字体大小怎么设置? ckshy 2019-12-25 39873 14425324 2019-12-29 22:40
[原创] FPGA人才缺口大,国内FPGA行业面临挑战!  ...2 mdy-郭柏荣 2019-8-27 166274 杨义 2019-12-27 08:53
[求助] Modelsim软件使用问题  ...2 云中鹤叉 2013-3-7 117033 thjan65 2019-12-26 22:09
[讨论] FPGA综合工具的效果 edacw 2019-12-25 12300 jasper0608 2019-12-26 16:58
[求助] 关于数字预失真中信号的噪声处理 lixin4210 2015-12-3 23374 everhappy 2019-12-26 10:49
[求助] perl failed zhdwc123 2019-12-23 01687 zhdwc123 2019-12-24 17:59
[讨论] 这年头,做处理器核有前途吗? CPU.GPU啥的。 新人帖  ...2 jmjmjm123 2019-12-14 135790 cuso4 2019-12-24 11:39
[招聘] 上海/北京 平头哥大量招聘 permanent33 2019-11-27 83498 pds2009 2019-12-24 10:39
[求助] 一个ARM的硬件加速模块:支持链表搜索,位图功能,映射表修改等 新人帖 zyh51134 2019-12-17 32026 pds2009 2019-12-24 10:36
[求助] 请教jesd5.0 镁光emmc multiple write 问题。调试了一个多月了,心里着急 zhicc 2018-4-28 12824 wangyongpeng 2019-12-24 10:07
[转贴] 开始学习zynq第一天 明天,你好1 2016-10-5 54298 lingking 2019-12-22 19:44
[求助] irun哪个版本支持upf2.1 xiaocui0725 2019-12-18 12688 edacw 2019-12-21 21:46
[求助] 使用FPGA的MMCM定制时钟输出波形问题 新人帖 z-wang 2019-12-7 12243 YYFFLLMMNN 2019-12-20 11:16
[求助] 求Verilog实现的polar码译码程序 小明d 2019-12-20 02120 小明d 2019-12-20 09:43
[求助] 请教FPGA+68013写U盘 djqlyy2922 2019-12-19 11886 watertree 2019-12-20 07:10
[求助] 1000元购买极化码的SCL译码verilog源代码  ...2 visage518 2015-11-23 115725 小明d 2019-12-19 21:00
[求助] 用Chipscope抓取信号出现问题 gentlemanmei 2016-8-23 74448 hurrywork 2019-12-19 09:17
发一个除法的程序,我自己写的,逻辑功能能实现,但是加上时钟就有错了。 天地一逍遥 2009-8-6 73132 荒漠小草 2019-12-18 11:23
[求助] Delta-Sigma ADC数字滤波器的信噪比分析 levintt 2019-12-17 02082 levintt 2019-12-17 19:05
[求助] 全差分折叠Cascode放大电路MOS管参数 eryuerugu 2018-11-22 12600 SHAOJIHUA1234@1 2019-12-17 15:52
[求助] 求利用FPGA实现转发表功能的设计 - [悬赏 200 信元资产] 神殇丶 2019-12-16 22578 A1985 2019-12-16 11:13
[求助] 在用K7芯片例化一个MAC核的例子工程中包一个顶层出现错误,求大神指点 - [悬赏 100 信元资产] 神殇丶 2019-11-19 22437 神殇丶 2019-12-16 09:12
[求助] FPGA如何通过网络调试助手与PC建立TCP连接 fuxiaolicaicai 2019-5-23 32596 gauz 2019-12-15 11:58
[原创] 同步FIFO设计 MR.vol 2019-12-14 12725 lmkuo2006 2019-12-14 15:11
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条


手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-8-24 09:27 , Processed in 0.029344 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块