在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜全文
[讨论] 为什么关于FPGA测试的书籍这么少,几乎没有? guolehaohao 2016-12-29 74520 lgp510775906 2020-3-28 17:18
[求助] 请问AES算法加密迭代的问题 jiaslbang 2013-4-17 43364 lgp510775906 2020-3-28 17:12
[求助] 这是什么语法 新人帖 chen3ten 2020-2-19 83126 lgp510775906 2020-3-28 17:04
[转贴] 值得收藏的FPGA硬件PCB布局小技巧(AD) zhongyan 2020-2-15 42983 lgp510775906 2020-3-28 16:53
[求助] 真正的数字IC开发还是在用quartus吗??  ...2 adan313 2017-9-3 1110799 lgp510775906 2020-3-28 16:45
[求助] 请问一下现在的FPGA支持内部三态门接口吗 - [已解决] yishuad 2020-3-24 23545 yishuad 2020-3-28 11:54
[原创] 数字芯片设计 新人帖 willysansen 2020-3-28 02540 willysansen 2020-3-28 11:05
[求助] 关于`define的作用域的一些疑问?  ...2 YYFFLLMMNN 2016-9-27 1215037 wanhua 2020-3-27 16:26
[讨论] 如何在IP设计层面预估功耗? - [阅读权限 30] luoyanghero 2020-3-27 036 luoyanghero 2020-3-27 10:24
[求助] 怎么用fifo实现数据包的连续输出? Mazak 2020-3-26 02344 Mazak 2020-3-26 18:45
[求助] xilinx cordic 6.0 sin/cos 核的使用问题 peter7776 2020-3-25 02432 peter7776 2020-3-25 16:43
[求助] quartus program error ,这啥情况啊,大神指个方向啊啊啊啊啊啊 lotfy 2020-1-4 22160 lotfy 2020-3-25 10:26
[求助] DC综合system Verilog怎么设置脚本 east1203 2019-7-13 55964 OPOPOPOPOPOP 2020-3-25 09:53
[求助] 怎么给一段串行数据每隔一定周期插入0? 新人帖 Mazak 2020-3-24 32168 A1985 2020-3-25 09:23
[原创] 分享一个超级便宜的Xilinx下载器,几十块就能买到 limubai 2020-3-19 22926 cdutcl 2020-3-24 19:08
[原创] Xilinx下载线超高速还便宜,赶紧上车 limubai 2020-3-24 12183 cdutcl 2020-3-24 19:07
[求助] Sigma-delta 与CIC数据处理问题 wanglscool 2012-2-6 64251 jeffej 2020-3-24 18:01
[原创] (Xilinx-7系配置2) 位流位宽检测机理 cdutcl 2020-3-24 02017 cdutcl 2020-3-24 13:52
[原创] (Xilinx-7系配置1) 数据文件格式详解 cdutcl 2020-3-24 02619 cdutcl 2020-3-24 13:50
[转贴] glibc 里面rand函数的实现 luoyanghero 2020-3-24 02372 luoyanghero 2020-3-24 13:34
[原创] Xilinx xc7k325t 内部构造介绍 cdutcl 2020-3-23 23131 nitheshbk 2020-3-24 13:19
[求助] 各位大佬问一下数字IC硕士论文适合哪一块? 新人帖 Mr.ZhenXi 2020-3-19 12236 richardxingxing 2020-3-24 11:47
[求助] 关于spectreverilog不支持64位cadence ,求大神解释 方倩 2016-4-14 97553 xiaoquanic 2020-3-24 11:38
[求助] 请教altera 三速以太网的奇怪问题,高手请进 Airlex 2016-1-12 12811 li123770 2020-3-24 09:51
[原创] 为什么彩电在没有信号的时候是黑白雪花 luoyanghero 2020-3-24 01755 luoyanghero 2020-3-24 09:25
[资料] 分享黑金ZYNQ7000系列视频教程  ...2 engelbert 2016-11-14 179926 cdutcl 2020-3-23 18:02
[求助] 关于delta-sigma 输出······· lizhaohong520@ 2012-1-13 52851 jeffej 2020-3-23 10:44
[原创] 完全异步复位电路设计危害 精华3  ...23456..7 飘渺仙 2017-1-17 6131409 iNostory 2020-3-23 10:17
[求助] debussy 仿真:怎么才能支持2001版Verilog love80238023 2010-3-6 85691 symail 2020-3-23 09:52
[求助] 请问一下,verilog测试时需要对外加测试信号进行控制怎么处理 新人帖 Moonlitseller 2020-3-21 12071 gaurson 2020-3-22 19:28
[原创] altera的器件如何正确的重启 ? american007 2020-3-22 01900 american007 2020-3-22 11:36
[原创] FPGA里做减法运算,需要转换为补码吗? american007 2020-3-17 43280 american007 2020-3-22 11:34
[求助] 请教累加器的问题 robberxiong 2012-5-23 45969 ricvadim 2020-3-21 21:15
[原创] 求购一些模拟和数字IP 447595064 2020-3-20 01866 447595064 2020-3-20 17:05
[求助] springer 里的电子书是什么途径得到的啊 39123811 2020-3-10 32234 thjan65 2020-3-19 23:35
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

X

手机版| 小黑屋| 关于我们| 联系我们| 用户协议&隐私声明| 版权投诉通道| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 ) |网站地图

GMT+8, 2025-12-23 22:28 , Processed in 0.034050 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块