在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜全文
[求助] 数字设计使用latch到底有什么弊端?  ...23 zh123456789 2010-7-31 2110830 zhustudio 2012-1-12 10:32
[求助] 请问大家关于CTS入门方面的知识,刚刚接触 atlandis 2012-1-11 22422 atlandis 2012-1-11 22:19
[求助] DDR2的local_init_done始终为低电平 orientview 2011-11-25 53473 zongkai2003 2012-1-11 10:02
如何在modelsim5.8中生成Quartus的库  ...2 shadow 2004-4-9 105043 hai0000001 2012-1-10 23:00
[讨论] Arria II GX FPGA ddr2控制器问题 genus001 2012-1-8 26836 genus001 2012-1-10 22:09
[原创] 大家看看下面的代码有啥问题 ratdanlu 2012-1-9 76391 zhang2000 2012-1-10 21:27
[求助] 刚开始学verilog 写了个uart程序,请教大侠啦;每次都丢最后一位 332981030 2011-12-24 83097 太阳公子 2012-1-10 20:24
altera fpga 中文讨论组,欢迎加入 stephen100 2007-10-25 12646 fengxie 2012-1-10 17:18
[求助] 在FPGA中如何计算CPU执行程序的时间  ...23 歪枣树 2011-2-23 208692 huxiaokai2005 2012-1-10 16:45
[求助] Booth乘法器综合 helongknight 2012-1-10 32943 zhq415758192 2012-1-10 11:20
[求助] FPGA开发板上的CPLD怎样恢复默认配置?初学菜鸟求助! justxyzxyzxyz 2012-1-9 22941 justxyzxyzxyz 2012-1-10 09:54
[求助] 关于DC设置set_max_delay 的问题 安妮远静 2012-1-5 86580 everhappy 2012-1-10 09:07
[求助] sp.v ps.v 和sys.v tangate 2012-1-8 32262 tangate 2012-1-9 19:20
[求助] synthesis的log裡總是有warning:Operating condition WCCOM set on design ... strong12345 2012-1-8 15102 zhq415758192 2012-1-9 08:48
[求助] 请教几个问题 mayiqun720 2012-1-7 12807 dreamylife 2012-1-8 14:17
[求助] modelsim中打不开.v文件 tangate 2012-1-3 45985 tangate 2012-1-8 09:32
[求助] mig初始化失败 kuige0803 2012-1-8 02350 kuige0803 2012-1-8 08:19
[求助] [DC] dc在report时,如果报文太长需要多次按空格才能继续打印到屏幕上 - [已解决] yzt000000 2012-1-5 76311 neoitachi 2012-1-6 21:24
[讨论] 代码规范 shxr 2012-1-6 28775 asyou 2012-1-6 17:37
[原创] 基于FPGA的SOPC实践教程 liujian_2009 2011-11-2 72930 songjinchao 2012-1-6 11:59
[求助] 关于源时钟和门控时钟间的相位差的问题 xiaoqiang87 2012-1-5 65101 jackertja 2012-1-6 10:33
[求助]Quartus II中综合例化后无元件  ...2 jayhust 2007-10-17 1620030 creazystone 2012-1-5 23:08
[求助] 在自己的设计中调用Quartusii生成的firIP核,然后在modelsim中进行仿真...求助 hidecom 2011-12-30 54605 creazystone 2012-1-5 23:00
[求助] RFID之读写器中的编码问题 oceanwangchao 2011-12-30 53513 xiaohonging 2012-1-5 15:41
[原创] 滤波器中的乘法运算设计  ...2 qinlongdwtdx 2011-12-28 1711493 greenwindstudio 2012-1-4 20:32
[求助] 哪种FPGA能例化多个DDR2 或DDR3 控制器? TiGX 2011-12-31 25385 asyou 2012-1-4 16:53
[求助] 急求高手编程指教 893198256 2011-12-30 42411 qlengyu 2012-1-4 08:17
[求助] spartan 6 oserdes2无输出 110500623 2011-9-3 23501 tiangua 2012-1-2 21:24
[讨论] 数字系统设计 nju044 2011-12-27 33069 nju044 2012-1-2 19:18
[求助] 如何把24位数据变为16位数据 adu5229543 2011-12-26 74099 xp05041188 2012-1-2 19:08
[求助] 有谁了解NETFPGA的信息吗? shawnelee88 2011-6-15 12820 lizxgg 2012-1-2 16:28
[求助] 弱弱地问一下,nios II本质上也是用硬件描述语言写的吗? sarlaga 2012-1-2 01484 sarlaga 2012-1-2 14:52
[原创] 请教这个结构的作用  ...23 atlandis 2011-12-31 217602 nicholas08 2012-1-2 09:40
[求助] quartus的版本问题 wkx820313 2011-12-31 22454 xiaoli055 2012-1-2 02:26
[求助] 主时钟clk的分频信号 能在always中 作为被检测的时钟么? 下面是我遇到的问题  ...2 leomeng 2011-11-16 105038 jerry_zjnb 2011-12-31 22:23
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条


手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 ) |网站地图

GMT+8, 2025-11-5 04:39 , Processed in 0.076732 second(s), 7 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块