在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜全文
[求助] Altera内存问题 neogeo3721 2011-12-7 74443 fuyaolong 2011-12-16 20:50
[求助] 关于test_bench shxr 2011-12-15 93434 asic_wang 2011-12-16 17:03
[讨论] 关于DC的report_power -hier问题 ohgreat 2011-12-16 02261 ohgreat 2011-12-16 16:25
[讨论] cadence 软件AE 这个职位怎样? heshufeng 2011-12-16 12913 nicholas08 2011-12-16 15:41
[讨论] 关于system generator里面添加microblaze project stevenzhang81 2011-12-16 23615 stevenzhang81 2011-12-16 15:30
[原创] 关于lvpecl的AC 耦合电阻 twfly 2011-12-8 23594 wjhzhx 2011-12-16 14:15
[求助] mig 3.7 ddr2 core数据线宽度问题 hxfwdzx 2011-12-16 02273 hxfwdzx 2011-12-16 13:43
[求助] 请教一个nios的问题 wkx820313 2011-12-15 12094 buley 2011-12-16 13:00
[求助] time analyzer wangminhua2 2011-12-15 51590 neoitachi 2011-12-15 23:32
[求助] 一个关于8563T的问题 snowinmoon 2011-12-15 01909 snowinmoon 2011-12-15 21:40
[求助] Quartus II常见错误 DDR-DDR2 qingweisan 2011-12-15 33385 qingweisan 2011-12-15 19:12
[求助] Altera是不是删掉了CAM(内容可寻址存储器)的IP? TiGX 2011-12-13 43281 jincheng235 2011-12-15 18:24
[求助] must be driven by a non-inverted input pin or another PLL,这该怎么解决呢? a52581120 2011-12-13 25482 a52581120 2011-12-15 12:09
[求助] 请教一个verilog的问题 kaichen 2011-12-4 62885 a52581120 2011-12-15 11:53
[求助] FPGA内嵌RAM块中的内容可不可以看到? 歪枣树 2011-12-10 32083 a52581120 2011-12-15 11:52
[求助] 流水线技术是怎么降低功耗的呢?高人指点一二  ...2 zjl840928 2011-8-29 1210041 a52581120 2011-12-15 11:40
[求助] DC运行没有错误 只有warning会对后端设计有影响吗 愤怒的小鸟 2011-4-26 92979 xumailster 2011-12-15 11:01
[求助] 求modesim教程 wlyj000 2011-12-14 31839 hua2011sz 2011-12-14 22:57
[求助] QUARTUS II 综合后网表涵盖什么信息? 歪枣树 2011-12-7 22149 zhanjunyi 2011-12-14 22:32
[讨论] 怎样在linux下通过脚本运行modelsim,verdi等程序,实现工作流程自动化? 禅师1988 2011-8-19 56455 remnant 2011-12-14 22:22
[求助] quartus新手问题 mazama 2011-11-20 73549 zhanjunyi 2011-12-14 22:10
FPGA实现USB转串口  ...2 soundsong 2006-10-25 1112592 jb7955 2011-12-14 21:53
[求助] 请大家帮我看一段verilog代码  ...2 yanzhengkuaile 2011-12-13 134185 zhanjunyi 2011-12-14 21:51
[求助] quartus仿真小问题 laoqiang 2011-12-11 53997 zhanjunyi 2011-12-14 21:47
[求助] FIFO 的小小疑问 求各位大侠指教 leomeng 2011-12-13 42404 zhanjunyi 2011-12-14 21:43
[原创] Technology map viwer post fitting emlair 2011-12-11 43125 zhanjunyi 2011-12-14 21:42
[求助] 传输门中晶体管衬底是怎样连接的,还有数字电路中MOS管的衬底是怎样接的 zhouweiscut 2011-12-14 36677 zhanjunyi 2011-12-14 21:39
[求助] 过程连续赋值问题 neogeo3721 2011-12-14 64369 zhanjunyi 2011-12-14 21:34
[求助] buffer ram fifo比较和应用 hattic 2010-3-11 610996 zhanjunyi 2011-12-14 21:32
浅谈VHDL/Verilog的可综合性以及对初学者的一些建议  ...2 zhouhong 2009-2-27 104963 zhanjunyi 2011-12-14 21:31
[求助] verilog 16进制译码难题解决  ...23 older123 2011-11-30 258807 older123 2011-12-14 19:25
[求助] time quest emlair 2011-12-13 32290 emlair 2011-12-14 13:15
[求助] 关于FIFO延时以及移位寄存器的疑问,请高手指教! shenqizhiren 2011-12-13 44182 qlengyu 2011-12-14 08:35
[求助] 万事开头难 zbtian 2011-12-12 53729 liujian_2009 2011-12-13 23:46
[求助] 急求助!quartus工程的时序问题 xiaoli055 2011-12-13 22721 johnnyluck 2011-12-13 21:10
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条


手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-9-15 21:35 , Processed in 0.069391 second(s), 4 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块