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楼主: bwl19881019

[求助] cpld 计数器 从0开始计数记到16停止， 上电之后计数器不工作。

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pontiff
发表于 2012-2-14 14:54:42 | 显示全部楼层
用综合软件看下你代码最终实现的硬件是什么样子的，这样就可以分析为什么没实现预期的功能了。
有时候这是最方便的方法。
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wrhwindboy
发表于 2012-2-17 19:15:50 | 显示全部楼层
我感觉他是FPGA里面 的计数clock频率太高了。他的示波器可分辨的频率又太低。其实rst解除后是从
0到16计数的，只是他看不出来
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wrhwindboy
发表于 2012-2-17 19:20:47 | 显示全部楼层
我感觉他是FPGA里面 的计数clock频率太高了。他的示波器可分辨的频率又太低。其实rst解除后是从
0到16计数的，只是他看不出来
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zzczx
发表于 2012-2-17 20:34:44 | 显示全部楼层
直接先仿真就知道有没有问题了。 估计是有，你没有抓到而已
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