在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜帖子
[求助] 求助!!!!vivado选fpga时,这个型号中的civ是什么意思! - [已解决] kaw1 2023-5-13 83129 kaw1 2024-4-16 15:16
[原创] 用FPGA实现简单的UDP/IP通信 精华3  ...23456..19 dogbear2245 2017-1-16 18188550 zxr789 2024-4-15 22:30
[讨论] 问个问题,1个clock和两个经过PLL产生的clock  ...2 scutlee 2024-4-11 122241 xhopo 2024-4-15 16:32
[求助] 烧录失败 spring_biubiu~ 2024-4-15 0640 spring_biubiu~ 2024-4-15 15:00
[资料] 求s家cxl ip的databook~ - [已解决]  ...2 lanren001 2022-3-28 124845 wang21202 2024-4-14 22:09
[求助] !!求Verilog中case功能的综合优化算法!! 新人帖 YYTS 2024-4-14 11005 YYTS 2024-4-14 17:50
[资料] 2015_Formal_Verification_An_Essential_Toolkit_for_Modern_VLSI_Design 思慕悟言 2024-4-13 0815 思慕悟言 2024-4-13 18:23
[原创] 如何学好数字IC前端设计 新人帖  ...2 战绽 2024-3-14 142281 战绽 2024-4-13 16:43
[求助] 如何自动对异步fifo进行功能验证? 钢铁孙 2017-4-4 54594 亮晶晶~ 2024-4-13 16:29
[求助] 数字芯片新工艺评估流程 新人帖 zhx_sm 2023-2-6 22006 FrozenlipX 2024-4-12 15:54
[求助] 求助实现一个公式的计算 yl_070 2024-4-12 21200 yl_070 2024-4-12 14:38
[讨论] 每个RTL文件都要加timescale吗? scutlee 2024-4-10 31233 kk2009 2024-4-12 13:05
[资料] Code:The Hidden Language of Computer Hardware,2nd ed @2023  ...2 2046 2022-11-11 194844 alenanderson 2024-4-11 22:13
[求助] 请教各位,verdi波形查看,打开波形后部分信号是NF  ...2 kdfeifeng 2018-4-19 1428253 wanhlin 2024-4-11 17:38
[原创] 用物联流量卡的监控器能改变移动流量卡吗 我威keniukaka 2024-4-11 01072 我威keniukaka 2024-4-11 17:38
[求助] questasim仿真时选择simulate without optimization报错 fuxiaolicaicai 2020-5-11 55078 Zel 2024-4-11 17:00
[求助] 逻辑综合产生的Timing 和 Cell报告中的属性是什么意思? Wade_ 2024-4-11 0872 Wade_ 2024-4-11 16:36
[讨论] 做矿机芯片的好跳槽么??  ...2 scutlee 2024-3-17 102074 scutlee 2024-4-11 13:58
[讨论] 弄错 新人帖 jy7 2024-4-11 0847 jy7 2024-4-11 12:01
[讨论] 一组bus的很多根线一起引到芯片外部,如何保证延时一样呢?? scutlee 2024-2-23 41254 丰少 2024-4-11 11:33
[求助] USB3.0协议中,传输的burst size是什么意思呢 ICer_178 2024-3-13 71860 ll_uestc 2024-4-11 10:15
[资料] 北京交通大学2021数字集成电路设计课件  ...2 SUHOZhang 2022-3-1 185985 cmmjava 2024-4-11 02:33
[原创] 抛砖引玉,同步器(三) 精华3 immonster 2012-12-24 78098 小鸟探戈 2024-4-9 17:32
[原创] Verilog语法精粹  ...234 johnny1209 2012-3-18 3125602 free_dreamer 2024-4-9 16:42
[求助] 咨询.18工艺下IO PAD对输入时钟频率大小的要求  ...23 agumonx 2021-8-4 2710539 我要去NV數位 2024-4-8 18:11
[原创] 寻找数字IC设计的小伙伴 stellavip 2024-4-1 21300 yjfzzz 2024-4-8 17:53
请问designware 怎么在fpga上应用?  ...2345 sylkyo 2008-6-3 4121504 heidong123 2024-4-8 17:52
[求助] DC综合时时序约束 get_pins data_reg/D找不到,但是在compile_ultra之后可以找到,请大神指点这....  ...2 yuming_ziyi 2022-12-16 145969 ahzhangyq 2024-4-8 17:21
[求助] PCIe上电配置内存空间问题 neXtime 2024-4-8 21047 neXtime 2024-4-8 16:51
[求助] 学习IC有没有什么好的入门资料 dreamfly123123 2024-3-29 31294 puxiancheng 2024-4-7 14:11
[原创] virtuoso终于出新版本了,知道的人帮忙看下,有什么改进。 ic_expert 2024-4-7 12352 freecore 2024-4-7 13:41
[求助] 加法器的设计 - [已解决] ahzhangyq 2024-4-2 51603 ahzhangyq 2024-4-7 11:46
[资料] Formal+STA 能否代替 Post-Sim  ...23 河源皮 2017-10-24 2611255 yuanpin318 2024-4-5 09:55
[求助] IIC从机的DC综合,时序图出现高阻态 追驰Chasing 2024-3-14 71600 追驰Chasing 2024-4-4 16:34
[原创] Verilog基本电路设计之二(时钟无缝切换) 精华3  ...23456..12 杰克淡定 2016-6-16 11684404 cmmjava 2024-4-4 13:47
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条


手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-9-12 04:17 , Processed in 0.016990 second(s), 4 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块