在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
[求助] verilog 多次加载数据 更优雅一些的写法 新人帖 Haleski 2024-1-30 41200 guoweituo 2024-3-4 14:29
[求助] 时钟如何切换? Wade_ 2024-3-1 31118 harry_hust 2024-3-4 10:32
[招聘] 【存储芯片内推+高薪福利好】合肥康芯威存储技术有限公司内推 attach_img einkingyw 2024-3-4 11092 jiangnaner 2024-3-4 10:13
[求助] 有没有可以抓PCIE TLP包的软件 geek86 2023-11-22 41324 geek86 2024-3-4 09:50
[讨论] 前端的同学做spyglass CDC都遇到什么问题 scutlee 2024-3-2 2950 silent_speak 2024-3-4 08:37
[求助] 在simics+solaris10下,用artisan memory compiler无法生成GDS文件 idoiwant 2023-10-26 21306 renrensd 2024-3-3 16:12
[讨论] AXI exclusive monitor scutlee 2024-3-2 31035 Cpual333 2024-3-3 11:40
[讨论] hold time violation怎么修?? scutlee 2024-3-3 1969 AlvinRolling 2024-3-3 09:50
[讨论] 做前端的朋友有遇到什么后端的问题需要前端来解决吗?? scutlee 2024-2-20 91330 scutlee 2024-3-3 00:45
[讨论] 基带芯片设计相关 新人帖 sunjy17 2024-3-1 3968 sunjy17 2024-3-3 00:15
[求助] FORMALITY报错 8i8i9o9o 2023-10-26 41526 668225 2024-3-2 21:19
[讨论] 前端的朋友做后仿都遇到什么问题?? scutlee 2024-3-2 0581 scutlee 2024-3-2 19:01
[资料] VESA Monitor Timing standards attachment nianhai1212 2024-1-26 71303 im.leo 2024-3-2 10:48
[讨论] 可综合TRNG设计 hjc19951212 2024-2-27 41109 hjc19951212 2024-3-1 16:25
[求助] 同步应该打几拍? Wade_ 2024-2-28 91419 马义鹏 2024-3-1 14:18
[资料] soc设计流程详细指导书,包括VCS 、ICC、DC。 attachment  ...23456..22 nwpuwangxf 2015-10-26 21451208 wangzzhe 2024-3-1 11:03
[求助] 怎么用ASIC硬件来实现这个? attach_img orientview 2024-2-27 41220 kk2009 2024-3-1 02:08
[求助] ICC route之后verify_lvs报错floatng及短路问题 attach_img liuqlh 2024-2-29 1859 liuqlh 2024-2-29 20:53
[求助] ICC报错 新人帖 liuqlh 2024-1-9 2936 liuqlh 2024-2-29 17:49
[求助] JTAG无法连接R8051XC2-B attach_img welco 2020-12-24 22321 McuPlayer2013 2024-2-29 17:36
[求助] cortex-m0 mcu低功耗降低系统时钟频率的问题 新人帖 MLX010114 2023-4-8 11647 McuPlayer2013 2024-2-29 16:20
[求助] max_transition yuanpin318 2024-2-23 61540 geek86 2024-2-29 09:48
[求助] Cortex M0+进入WFI后,可以关闭u_core,u_matrix的电源吗? 多线程维生素 2024-2-28 1723 多线程维生素 2024-2-28 21:30
[求助] DC综合时max transition违例 新人帖 attach_img madanjie 2024-2-28 11204 modoalos 2024-2-28 21:12
[求助] 关于dc综合后时序报告的一些疑惑 打不出空白 2024-1-10 72051 robin0612 2024-2-28 17:00
悬赏 [求助] 多阈值电压设计为什么一般放后端做呢? - [悬赏 100 信元资产] ZTQNB 2024-1-28 41535 robin0612 2024-2-28 16:57
[求助] 怎么把要复用的小模块弄成库呢 kyaaaa 2024-2-28 0743 kyaaaa 2024-2-28 09:17
[资料] tanner集成电路与设计教程(第二册) attachment  ...2 lideli5 2012-7-23 176646 rsmicro 2024-2-28 01:21
Verilog-A的模拟电路行为模型及仿真 attachment  ...23 wapoca 2009-8-30 2214060 jihuang0212 2024-2-27 16:31
[求助] 新人求助FIR插值滤波器的Verilog代码 dyczs 2023-6-13 41518 liu666+ 2024-2-27 16:19
[求助] 求stm32f413 中DMA2D 的源码, lewis.l.l 2024-2-27 0676 lewis.l.l 2024-2-27 13:54
[讨论] 关于CIC滤波器溢出处理  ...2 挂在天边的鱼 2014-6-24 1516236 ZJU_emi 2024-2-27 11:24
[讨论] 一组信号同时跨时钟或者一组信号连到io pad scutlee 2024-2-23 1632 janetchin 2024-2-26 16:23
悬赏 [求助] CIC滤波器截位问题 - [悬赏 500 信元资产] ZJU_emi 2024-2-26 01443 ZJU_emi 2024-2-26 15:38
[求助] 关于swd如何访问soc外设寄存器的问题 sducut 2024-2-23 31486 daxueliujisheng 2024-2-26 11:04
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

小黑屋| 手机版| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-5-14 13:50 , Processed in 0.027177 second(s), 9 queries , Gzip On, MemCached On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块