在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜帖子
[招聘] 招聘兼职讲师:模拟版图和形式验证方向 wang19871001 2021-12-1 01752 wang19871001 2021-12-1 09:40
[求助] 采集示波器信号进行处理  ...2 Holmes爱嘤嘤 2021-11-25 104695 Holmes爱嘤嘤 2021-12-1 09:18
[求助] SRAM的retention voltage如何确定? nettlefish123 2021-11-30 12254 coolbear2021 2021-12-1 08:52
[招聘] 招聘老师啦,做USB3.0协议和PLL模拟电路的 过来看看呀 wang19871001 2021-11-25 11690 saipolo 2021-11-30 23:12
[招聘] 兼职讲师:形式验证和USB3.0 协议 wang19871001 2021-11-29 12226 wang19871001 2021-11-30 17:14
[求助] 子模块 set_input/output_delay set_min_delay 学习使我快乐 2021-11-24 83061 学习使我快乐 2021-11-30 14:39
[求助] 有大佬做过利用OpenFPGA平台生成FPGA软核吗? - [悬赏 50 信元资产] kangliyu 2021-11-30 11874 innovation 2021-11-30 13:22
求MT48LC8M16A2行为级仿真模型 wangee 2009-5-9 22989 jackzhang 2021-11-29 21:20
[求助] FIFO存储器选择 雨中有座沧浪亭 2021-11-29 22414 loglong 2021-11-29 14:18
[求助] 关于带power 和 gnd的单元的综合问题 新人帖 sharpmental1979 2021-11-25 22608 sharpmental1979 2021-11-27 11:13
[解决] 【菜鸟提问】Verilog头文件没有效果  ...2 踟蹰的天 2021-11-23 156235 踟蹰的天 2021-11-26 23:22
[讨论] 请问Xilinx是否推荐基于Slice内部的专用Multiplexers(F7MUX, F8MUX, F9MUX)实现宽输入的逻辑表达... innovation 2021-9-17 23271 innovation 2021-11-26 20:06
[求助] 关于Synopsys 的.lib和.db文件的问题 yzx90333 2017-12-12 47375 拾西 2021-11-26 16:19
[求助] 求DS28C36完整版datasheet 新人帖 - [悬赏 500 信元资产] hustzkl 2021-11-26 02478 hustzkl 2021-11-26 09:01
[求助] 【菜鸟求助】关于SMIC库 新人帖 2126271775 2021-11-25 02193 2126271775 2021-11-25 22:55
[求助] AXI总线的问题 - [悬赏 10 信元资产] kangliyu 2021-11-23 95883 aegeus 2021-11-25 19:20
[求助] 求购STM32兼容外设ip smalltalk 2021-11-23 12163 鸥鸟忘机 2021-11-25 18:02
[求助] FPGA开发时的问题 - [已解决] kangliyu 2021-11-23 72820 kangliyu 2021-11-25 13:44
[求助] 关于编译时总报10839错误的问题. xvb13135 2019-8-2 86431 nannan666 2021-11-24 22:26
[原创] FPGA Tools Synthesis QoR Benchmark 精华3  ...234 Timme 2013-6-22 3629139 keepfaith4ever 2021-11-24 11:17
[求助] 时序电路的敏感信号不知道到底最多应该可以写几个 ,才能综合成电路?  ...2 wangmeng_sail 2021-11-18 144308 cfly_chang 2021-11-24 09:19
[原创] CMOS 比较器学习总结  ...2 wkp1992101 2019-5-21 146857 greener 2021-11-23 23:36
[求助] 求助:ISE14.7 如何查看报告中的等效门电路 luxifaweifeng 2015-12-23 56293 adoniswoo 2021-11-23 19:20
[求助] 反标问题: encounter 导出的setload setres sdf spef spf 的用途和区别 hua2011sz 2011-12-6 57339 IC未入门的小波 2021-11-23 19:09
[求助] 请问DC综合的乘法器是什么类型的?有必要再用verilog专门写一个乘法器吗?  ...2 wangxuede220 2010-10-19 1713426 用户年轻化 2021-11-23 17:15
[求助] verilog代码问题 小花321 2021-11-23 62530 smarthb 2021-11-23 15:46
[求助] 求v-tcam_ts40gtcam111hsetss stevenchung 2021-11-22 11997 stevenchung 2021-11-23 15:21
[求助] verilog if(en)和if(en==1'b1)有区别吗?综合的电路都是一样的吗? a7565169 2021-11-16 62637 qq1035963065 2021-11-23 11:45
[统计] 为何数字后端需求这么大?详细的划分岗位实在是多 wang19871001 2021-11-23 03158 wang19871001 2021-11-23 11:36
[求助] 前端做综合的时候set_clock_transition设定问题 xbllzf 2021-11-23 01671 xbllzf 2021-11-23 11:06
[求助] altera fifo异常问题 fascinate_lyd 2021-11-22 11749 smarthb 2021-11-23 10:04
[转贴] 求教关于一段式uart rx部分的代码 sktwo 2021-11-19 12298 zzj0329 2021-11-22 17:36
[求助] 这样写Vivado会综合成BlockMemory吗 PayPal 2021-11-11 63222 PayPal 2021-11-22 17:15
[求助] 如何将CPU执行的代码快速下载到片内SRAM中? 新人帖 - [已解决] chensiheng 2021-11-17 42602 chensiheng 2021-11-21 19:40
[资料] PCIE3.0 协议英文版  ...23 Ground_lan 2016-8-29 2911698 oushuyun 2021-11-21 14:30
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条


手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-9-13 00:10 , Processed in 0.023479 second(s), 4 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块