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数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 1 |主题: 31144|排名: 12

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[原创] 谁有模拟集成电路设计软件	synrenjay 2010-9-10	02066	synrenjay 2010-9-10 15:41
[原创] 灌水	synrenjay 2010-9-10	02904	synrenjay 2010-9-10 15:35
[原创] 灌水啦。。。	synrenjay 2010-9-10	02512	synrenjay 2010-9-10 15:34
[求助] 请教高手，时钟信号做数据	cnzhang 2010-8-20	63704	mosou 2010-9-10 15:28
[求助] 关于串口通信的许多问题	liumh 2010-9-1	22859	xc5552003 2010-9-10 14:57
[求助] 关于if语句 ...2	shxr 2010-8-23	135770	xc5552003 2010-9-10 14:45
[原创] 求助：Cadence混合仿真出错	ieeepanda 2010-8-23	33255	风行万里 2010-9-10 14:42
FPGA的速率在逻辑很复杂的时候是不是会降很多，谢谢 ...2	coolhunter 2003-10-10	105327	cllf 2010-9-10 14:12
初来宝地，欲交流SOC设计经验 ...2	老扁 2003-10-9	127279	cllf 2010-9-10 14:10
为什么只能进行功能级仿真，别的仿真做不了？ ...2	aini 2003-9-25	165186	cllf 2010-9-10 14:09
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if语句的执行顺序问题 ...2	7867 2003-8-30	106029	cllf 2010-9-10 13:22
[求助] Modelsim后仿真问题	cherry26 2010-5-29	53710	lixqing 2010-9-10 12:19
[求助] 测试代码问题	shxr 2010-9-8	74832	AmoiBB 2010-9-10 09:19
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[求助] Xilinx-ISE8.2i中波形仿真时候INOUT型口做输出时候怎么都出不来信号波形,为何？	Akill 2010-1-28	14623	hyg007 2010-9-9 17:01
[求助] 求助关于signal tap,大概会占去FPGA多少资源？	xiaocanmeng 2010-9-7	11990	caique 2010-9-9 16:52
[求助] 跪求 xilinx ISE 8.2 序列号	hyg007 2010-9-9	02437	hyg007 2010-9-9 16:35
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