关于verilog SOS

xen_Mar · 发表于 2010-9-1 09:53:42

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/问一下各位高手
verilog 中如果这么定义位宽 reg [7:0] abc; 与reg [0:7] abc; 二者之间有区别吗？谢谢

zh123456789 · 发表于 2010-9-1 12:05:12

有，高低位顺序不同

gaurson · 发表于 2010-9-1 12:06:45

定义上没有区别，但内容装载方式就要看你赋值的另一方是什么顺序了。

yuanpin318 · 发表于 2010-9-1 16:11:42

different order

xen_Mar · 发表于 2010-9-6 15:39:07

谢谢各位纠结几天了

smartboy918 · 发表于 2010-10-22 22:48:28

thanks a lot.

lycxy521 · 发表于 2010-10-23 23:35:15

thanks a lot.

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