在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜帖子
[求助] circular ram 与fifo区别 smow 2010-10-7 32107 smow 2010-10-9 21:53
[招聘] 找兼职讲师:IC 设计培训类,前端后端  ictrainnet 2010-10-9 13366 xiaowanzi88 2010-10-9 13:18
[求助] FPGA中pll使用的问题 sicheng139 2010-5-21 74879 p2p.angus 2010-10-9 12:41
[活动] 针对 Virtex-6®和 Spartan®-6 FPGA 设计的低功耗解决方案 jackzhang 2010-9-9 66881 cq_lc 2010-10-8 22:49
请教谁使用过CYCLONE内部的PLL进行倍频设计? lishiyi 2005-5-8 55478 jyhking 2010-10-8 22:17
[求助] v5,ad9980配数问题 chen981001 2010-10-7 12788 chen981001 2010-10-8 20:46
[求助] 马上要进入研究生的学习了...请教各位 pc871226 2010-7-3 93569 wangxuede220 2010-10-8 16:50
[原创] Opensource EDA design flow renminggong 2010-10-7 23287 sain_1989 2010-10-8 10:34
[求助] 初学edk,有点问题请教。 qd0090 2010-9-3 33216 xs_uestc 2010-10-7 14:03
[求助] 那位高手有Xilinx EDK的资料 推荐下!! daisywmc 2009-12-23 64482 xs_uestc 2010-10-7 13:57
[原创] 关于xilinx的EDK,程序挂掉,大家用过吗 weizhiheng 2010-4-3 33545 jeedtot 2010-10-7 00:12
[求助] 使用edk下载时出错,请教原因 qd0090 2010-4-19 34967 yuanwolf2008 2010-10-6 18:09
[求助] edk下载成功但是没有信号 qd0090 2010-5-3 32297 yuanwolf2008 2010-10-6 17:06
[求助] EDK中的DMA的应用 picassoye 2010-7-19 95100 yuanwolf2008 2010-10-6 16:49
[求助] EDK外部中断的问题 qd0090 2010-9-7 73304 yuanwolf2008 2010-10-6 16:31
请教大侠,建标准单元库的流程如何,能提供教程最好。(见内容) xlu 2004-11-3 24519 zb8521 2010-10-5 04:41
[活动] lowpower版开版讨论 creese 2010-10-3 33370 creese 2010-10-3 12:56
[求助] ml510上有支持I2S音频格式的芯片吗? hgdai 2010-10-3 01776 hgdai 2010-10-3 10:11
[求助] nc-verilog 仿真出来的两个文件是什么? maclei 2010-9-11 79942 soelife 2010-10-2 21:54
[求助] 关于Verilog的问题 arsenal1215 2010-9-26 83157 levin.lg 2010-10-2 01:08
问个I2C应答信号的问题 feitengyu 2008-12-28 23270 levin.lg 2010-10-2 00:57
[求助] cyclone iii外部有5V的信号,应该如何设置才能兼容? feitengyu 2010-9-27 25774 levin.lg 2010-10-2 00:51
[求助] 关于FPGA和主机之间通信的问题 xuruomu 2010-9-30 12560 fhy 2010-10-1 11:49
[求助] 关于FF的CK和RN的setup问题?  ...2 meijingguoyu 2010-9-15 156102 meijingguoyu 2010-9-30 17:35
[求助] 求 ise_11的中文版指南 ay3man1981 2010-9-30 02415 ay3man1981 2010-9-30 15:55
[求助] 关于Altera官方培训ppt或者PDF foveryoung 2010-9-30 03526 foveryoung 2010-9-30 15:14
[讨论] 怎样统计输入端‘1’的个数 mihayilov 2010-9-29 94741 nan123chang 2010-9-30 13:35
设计电路确定当前32bit数能被5整除  ...2 target13 2009-11-13 126688 guoyu 2010-9-30 11:33
[求助] NIOSII如何编译生成HEX文件? skyccd 2010-9-30 03744 skyccd 2010-9-30 11:08
[讨论] xilinx研修班怎么样? picassoye 2010-9-28 53792 picassoye 2010-9-29 12:40
[求助] Debussy编译出现问题,为什么???? bandit 2010-9-27 33023 csliyuan 2010-9-29 11:57
[求助] 发现我的QII 的HELP菜单没法用 ruiruio4 2010-9-28 22499 ruiruio4 2010-9-29 10:11
求:可以综合的VERILOG串转并的范例程序 huazai1984 2008-7-14 13501 zoufeizl 2010-9-28 22:32
[求助] Verilog实现关于24位输出的并串转换输出,附代码以及modelsim的仿真图。  ...2 willwillwill 2010-1-11 127951 zoufeizl 2010-9-28 22:21
[求助] Altera FPGA 如何保存常用数据 skyccd 2010-9-15 74069 skyccd 2010-9-28 16:58
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条


手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-9-12 14:39 , Processed in 0.082698 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块