在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
[讨论] use macro parama has not been defined scutlee 2024-4-24 0420 scutlee 2024-4-24 13:48
[求助] DC和PT中的时序约束是同一个吗?  ...2 flyingsheep 2013-3-25 1816834 方山剑客 2024-4-24 11:51
悬赏 [原创] 集成电路静态时序分析与建模-刘峰 - [悬赏 2 信元资产] attachment  ...23456 songsong001 2021-5-10 5916838 yuanpin318 2024-4-24 10:04
[求助] 始终信号能接入到寄存器的D口做逻辑使用吗? attach_img Wade_ 2024-4-23 21059 Wade_ 2024-4-24 09:34
[讨论] 假如芯片只有一个PLL,又要做clock gate scutlee 2024-4-15 6991 scutlee 2024-4-24 09:28
[求助] verilog中使用task出现的问题 attach_img  ...2 hxfwdzx 2012-1-3 1319554 binnq 2024-4-23 17:19
[求助] vcs 同步时钟采样问题-deraceclockdata没有用 xingerzh 2023-10-4 71938 binnq 2024-4-23 17:01
[资料] LEDA培训讲义 attachment  ...2 低空翾翔 2016-10-7 148052 yuanpin318 2024-4-23 10:52
[资料] uvm验证课程  ...234 fool123 2019-11-14 3013055 ZQDN4 2024-4-23 10:48
[原创] 请教大家,vcs仿真时间如何设置 ? american007 2023-5-8 64312 树欲静 2024-4-23 10:39
[求助] 哪位大佬哥分享一下,我们一般做MCU芯片里面的Flash 模块/IP的资料 BRN 2024-4-22 1702 深圳华芯 2024-4-23 10:31
[求助] VC Verification IP for SPI的Datasheet Ellis 2024-4-22 01189 Ellis 2024-4-22 22:12
[讨论] DDR 怎么时序约束 scutlee 2024-3-23 4904 robin0612 2024-4-22 16:46
[原创] spyglass check rules文档仅供大家一起学习 attachment  ...23 licongkai 2023-2-17 225460 kaixindelei 2024-4-22 11:15
[求助] 请问DC综合的set_max_fanout和set_max_capacitance有什么区别呢 xingerzh 2024-4-20 0501 xingerzh 2024-4-20 15:01
[讨论] 不编译用verdi打开filelist看代码 scutlee 2024-4-18 2907 gaurson 2024-4-19 17:22
[求助] ic设计vs验证 新人帖 yhcao 2024-4-17 51004 wuruic 2024-4-19 16:50
[求助] 求助一篇paper attachment gentle_man 2024-4-19 1789 DT27 2024-4-19 12:01
[求助] 求Synopsys Design Compiler 2017软件 attach_img 8i8i9o9o 2023-10-7 61371 hjtfsy21 2024-4-17 23:57
[求助] 求助关于NangateOpenCellLibrary的问题 attach_img 小茂 2014-4-15 34370 ilxsh 2024-4-17 14:06
[求助] 求帮忙,写断言时,使用|->操作符,vcs报错 attach_img like_play_nt 2024-4-17 1794 like_play_nt 2024-4-17 13:42
[资料] Vim UVM Snippets attach_img AlvinRolling 2024-1-17 11349 3almap 2024-4-17 00:20
[讨论] OR fangwang85 2024-4-15 3736 kk2009 2024-4-16 19:53
[求助] 求教上华0.5um工艺库怎么安装? 梦一直听不懂 2013-5-3 94160 D.BY 2024-4-16 15:55
悬赏 [求助] 求助!!!!vivado选fpga时,这个型号中的civ是什么意思! - [已解决] attach_img kaw1 2023-5-13 82565 kaw1 2024-4-16 15:16
[原创] 用FPGA实现简单的UDP/IP通信 digest agree  ...23456..19 dogbear2245 2017-1-16 18183863 zxr789 2024-4-15 22:30
[讨论] 问个问题,1个clock和两个经过PLL产生的clock  ...2 scutlee 2024-4-11 121656 xhopo 2024-4-15 16:32
[求助] 烧录失败 spring_biubiu~ 2024-4-15 0481 spring_biubiu~ 2024-4-15 15:00
悬赏 [资料] 求s家cxl ip的databook~ - [已解决] attachment  ...2 lanren001 2022-3-28 124121 wang21202 2024-4-14 22:09
[求助] !!求Verilog中case功能的综合优化算法!! 新人帖 attachment YYTS 2024-4-14 1807 YYTS 2024-4-14 17:50
[资料] 2015_Formal_Verification_An_Essential_Toolkit_for_Modern_VLSI_Design attachment 思慕悟言 2024-4-13 0659 思慕悟言 2024-4-13 18:23
[原创] 如何学好数字IC前端设计 新人帖  ...2 战绽 2024-3-14 141721 战绽 2024-4-13 16:43
[求助] 如何自动对异步fifo进行功能验证? 钢铁孙 2017-4-4 54238 亮晶晶~ 2024-4-13 16:29
[求助] 数字芯片新工艺评估流程 新人帖 zhx_sm 2023-2-6 21703 FrozenlipX 2024-4-12 15:54
[求助] 求助实现一个公式的计算 attach_img yl_070 2024-4-12 2959 yl_070 2024-4-12 14:38
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

小黑屋| 手机版| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-5-14 04:29 , Processed in 0.026780 second(s), 9 queries , Gzip On, MemCached On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块