在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
[求助] 关于BPSK、QPSK调制的载波问题??? wangj929281 2014-10-13 56325 wangj929281 2014-10-14 18:13
[求助] DDR3 ip核仿真时必须要接仿真模型吗 tcswyy999 2014-10-8 33499 sss08_leon 2014-10-14 18:00
[求助] create_clocks 的深深思考,求教! hongfeng575 2014-10-14 33308 chengroc 2014-10-14 17:04
[求助] 为何要禁用 TIE W13675308408 2014-10-13 32030 chengroc 2014-10-14 16:50
[求助] 为何要禁用set dont use smic18_ss/FFSD W13675308408 2014-10-11 12349 W13675308408 2014-10-14 16:12
[求助] RapidIO的学习 tangyonghit 2011-9-8 13025 suifeng_lll 2014-10-14 15:59
[求助] ddr3里的truebl4概念 linghuqiubai 2014-10-14 02095 linghuqiubai 2014-10-14 13:42
[求助] dc综合问题 nancyjj90 2014-10-14 32016 elone 2014-10-14 10:51
[求助] 求助:关于亚稳态?? attach_img  ...2 ajuehe 2012-1-2 158299 elec_zxm 2014-10-14 10:43
[求助] SV验证环境中,Driver总是主动的,DUT总是被动的吗? longxigen 2014-10-9 22170 elec_zxm 2014-10-14 10:40
[求助] modelsim仿真时 error loading design是怎么解决的 baobao697841 2014-10-13 22424 baobao697841 2014-10-13 15:28
[求助] 請問是否有此書integrated circuit design johnhsu 2014-10-13 02450 johnhsu 2014-10-13 13:07
[求助] FPGA外接DDR2互连线信号完整性怎么分析? peeer 2014-10-13 01522 peeer 2014-10-13 10:14
[求助] FPGA板上验证:SDK 结果与 CHIPESCOPE 结果不一致问题? 绝歌lilin14 2014-10-11 22388 绝歌lilin14 2014-10-13 08:37
求FPGA最小系统原理图 attachment  ...23456..9 dalewu 2007-9-9 8228576 atom1108 2014-10-12 23:40
[求助] modelsim 仿真 QuartusII FIR IP核无输出 球球JK 2011-11-22 85640 jeffrey3594 2014-10-12 22:47
[求助] 有没有带时序的ALU电路或者芯片? liuzexue 2014-10-12 01970 liuzexue 2014-10-12 22:27
[求助] AX88180以太网丢包原因求助 shenqixian 2014-8-31 14102 向心力 2014-10-12 18:54
[求助] aurora协议中的Framing和Streaming模式有啥区别??? 坤子 2014-9-22 13152 向心力 2014-10-12 18:43
[求助] 关于FPGA 开发板上flash的调用 wushuai420 2014-10-11 12221 mentoruser 2014-10-12 12:09
[求助] 谁知道一些FPGA用于IC测试的开发板或者一些现成的开发板 Eleven_wsy 2014-10-11 01534 Eleven_wsy 2014-10-11 23:46
DC综合后如何使用modelsim后仿真  ...23 xingwaixin 2009-6-1 249413 向日葵SUNNY 2014-10-11 19:17
[求助] VHDL 转 Verilog 求助。 input port 是 integer zero_0 2014-10-9 42727 zero_0 2014-10-11 17:12
[求助] VHDL转Verilog求助 zero_0 2014-10-11 02462 zero_0 2014-10-11 17:01
[求助] 如何将多个时钟周期的电平信号转化为一个时钟周期的脉冲信号? zhuyuefeng2009 2014-10-6 84371 zhuyuefeng2009 2014-10-11 16:48
[求助] 关于altera的altgx IPcore的问题 caiying1909 2012-9-21 64390 zsk1024 2014-10-11 15:57
[求助] ISE map fanny_haiyun 2014-10-10 33064 j200681106 2014-10-11 15:11
[求助] 求助verilog运算截取表述方式 bellinwater 2014-10-9 74466 layueliuhuo 2014-10-11 14:51
[原创] 32位流水线加法器verilog woai2020 2014-10-11 02751 woai2020 2014-10-11 12:19
[求助] 有玩过AT89S52的么?问个问题,希望高手解答 lunmag 2014-10-11 01743 lunmag 2014-10-11 11:51
[原创] FPGA 110chb 2014-10-11 02410 110chb 2014-10-11 11:50
[求助] VIVADO 在输入输出管脚没有接到I/O时怎么才能保证在布局布线时资源不被优化 leafboat 2014-7-29 512253 zhangwei0814 2014-10-11 09:52
关于 XILINX Zynq 极客挑战赛 评审结果 digest  ...23 jackzhang 2014-9-23 259225 ahcene2035 2014-10-10 15:56
[求助] DMA问题求助 a290727130 2014-10-10 02336 a290727130 2014-10-10 15:03
[求助] 求问“系统工程师”这个职位前途怎么样? attach_img 渐行渐远 2014-10-10 11884 渐行渐远 2014-10-10 14:46
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

X

小黑屋| 手机版| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-6-23 13:53 , Processed in 0.049252 second(s), 9 queries , Gzip On, MemCached On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块