在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
[求助] 关于同步复位和异步复位亚稳态概率  ...2 sjun 2014-12-9 155359 huangkai 2014-12-22 17:02
[讨论] 如何去学习FPGA  ...2 小金豆 2014-12-19 114613 小金豆 2014-12-22 11:55
[原创] 测pcie速度 多一点 2014-12-22 02046 多一点 2014-12-22 09:54
[求助] synplify2013没有产生.vqm文件 wn7 64系统 csyyj 2014-12-22 02401 csyyj 2014-12-22 09:49
[原创] 寻IC设计人员 隐伤残 2014-12-6 22681 loskawen007 2014-12-22 02:58
[求助] 流水线技术为何能提高系统频率?  ...2 xchenw 2012-7-25 136042 glace12123 2014-12-21 23:33
[讨论] FPGA PLL锁定谐波? eqgyzgs 2014-12-20 32381 越野 2014-12-21 22:18
[求助] 综合工具 yhbell 2014-12-17 22015 越野 2014-12-21 22:14
[转贴] 电子系统级设计(ESL):现实还是涂有外表之物  ...2 yechangan 2010-1-26 169630 yanx1236 2014-12-21 19:48
[求助] 简单信号发生求大神帮忙 attach_img xiekaboy 2014-12-11 72800 xiekaboy 2014-12-21 10:15
[求助] 将标准时钟CLK1分频后得到CLK2,怎么让CLK2与CLK1对齐? attach_img  ...2 zhuyuefeng2009 2014-12-18 136262 david94168 2014-12-20 11:04
[求助] 求教一个关于pcie 2.0的问题 xduryan 2014-12-15 12036 MElik003 2014-12-20 01:18
[求助] 求教:Xilinx FPGA 使用AXI4总线实现DDR3控制的问题 attach_img Y.R.Wan 2014-12-19 03291 Y.R.Wan 2014-12-19 21:26
[解决] formality读入library后,会产生后缀是#PWR的单元 zylxzxcyz 2014-12-15 32806 zylxzxcyz 2014-12-19 17:28
[求助] verdi200901安装问题??  ...2 chanon 2010-6-7 106830 chaojoe 2014-12-19 17:18
[求助] 怎么看懂wire load model mikeppq 2014-12-19 63562 mikeppq 2014-12-19 15:44
[求助] 寻求eMMC 5 host controller设计者 黄鼻头 2014-12-19 01257 黄鼻头 2014-12-19 15:28
[求助] 用两个不同的时钟控制同一个寄存器的问题(我写在纸上了),再发一次 attach_img  ...2 zhuyuefeng2009 2014-12-14 114318 ddxx 2014-12-19 11:14
[求助] 关于DC的时序报告有重复的关键路径 最酒店 2014-11-18 43054 最酒店 2014-12-19 10:28
[求助] ISE可以用iMPACT通过JTAG扫描到FPGA芯片Chipscope扫描不到 691564736 2013-12-10 36681 BigSouth 2014-12-18 23:11
[求助] 关于使用xilinx FIR Core 系数重载的问题 jdfish 2014-12-2 22203 jdfish 2014-12-18 15:06
[求助] FPGA扩展的RAM cljzgdzdjkflt 2014-12-17 12048 cljzgdzdjkflt 2014-12-18 15:06
[求助] SPARTAN 6串并转换输入管脚的问题 attach_img airsmiler 2013-3-20 23619 BigSouth 2014-12-18 11:46
[求助] input delay /output delay ? attach_img  ...23 shiyinjita 2012-1-12 2610159 503295064 2014-12-18 00:30
[求助] 遇到一个奇怪的问题,求解答! attach_img newaysoft 2013-8-28 83006 503295064 2014-12-18 00:28
[求助] 关于FPGA的LE中的SLOAD端口的疑问,向高手求教 a290727130 2014-7-15 43457 503295064 2014-12-18 00:07
[求助] 怎么将原有电路中的并行组合逻辑 全部 用 串行迭代时序逻辑 替代掉(有示意图)? attach_img zhuyuefeng2009 2014-12-14 62744 zhuyuefeng2009 2014-12-18 00:03
[求助] 新手真心求助7段显示器跑马灯 lodadesmond 2014-12-16 22517 lodadesmond 2014-12-17 23:02
悬赏 [求助] DE2-70上的摄像头视频采集,不会做啊,ov7725摄像头,用FPC插到扩展插槽, - [悬赏 5 信元资产] Lynn3080 2014-12-17 01825 Lynn3080 2014-12-17 19:09
[原创] 智多晶——FPGA/CPLD attach_img jxfzysf 2014-12-17 11994 jxfzysf 2014-12-17 16:38
[求助] 急求解答~~ISE生成DDR2的控制器,在仿真时的问题~~~ attach_img JIANGXHUA 2014-12-16 32091 rowen800 2014-12-17 16:33
[原创] 用低成本的ALTERA CYCLONE IV做TCP/IP协议的百兆以太网 cswcswcsw 2014-12-16 13084 haitaox 2014-12-17 10:47
[原创] 针对verilog 编写的VIM 函数 yuanqui_cn 2014-12-17 02250 yuanqui_cn 2014-12-17 07:24
[原创] 芯片前端的咨询 670687308 2014-10-27 32545 zpf2014 2014-12-16 22:46
[求助] 弄了一个多月,实在弄不出来,时序约束还是资源问题呀。  ...2 rokwlp 2011-9-14 126376 gg9132qq 2014-12-16 20:06
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

X

小黑屋| 手机版| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-6-24 02:15 , Processed in 0.044462 second(s), 9 queries , Gzip On, MemCached On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块