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[求助] vcs编译报错“\”cannot be opened for reading due to no such file or directory 新嘴小王安子 2020-11-2 24123 wx321 2023-10-18 16:27
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[求助] 怎样验证有多个跨时钟域的设计? 新人帖 aleebj 2023-10-16 1782 年轻的韭菜 2023-10-16 15:32
[求助] 怎样做到force design里面的wire信号但是不影响wire的另一端? goodideaooo 2023-10-1 5957 liheng369 2023-10-16 11:56
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[求助] ads中HBT模型问题 attach_img ZhiyongD 2023-10-11 4811 dongming 2023-10-12 21:17
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[求助] VCS能产生Indago的database吗 liheng369 2023-10-10 3988 saipolo 2023-10-11 21:05
[求助] USB3老是在发送数据时进入Recovery oscillator_cn1 2023-10-11 0560 oscillator_cn1 2023-10-11 18:52
[求助] vcs报错[RCUIPNA] Illegal references to $unit 新人帖 zjzaaa 2023-8-2 4959 zjzaaa 2023-10-11 15:45
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悬赏 [求助] uvm,验证环境怎么通过generate例化多个接口相同但是时钟不同的clocking块 - [悬赏 100 信元资产] yd452133823 2023-10-7 2856 zhangdeshuai 2023-10-10 17:24
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[求助] 跪求uvm的ip验证大型项目的完整代码  ...2 宋凡 2019-6-12 103806 troyguo1234 2023-10-10 10:46
[求助] UVM 中关于force 用法  ...2 Gavin-35 2023-9-7 103147 liheng369 2023-10-9 19:26
[原创] 断言可以写在verilog的可综合代码中吗 ?  ...2 american007 2019-5-17 118325 炒鸡屈服者 2023-10-8 16:20
[求助] xrun收集代码覆盖率不能出来层次结构 attach_img xiaoxiaoqi 2020-12-18 53967 YLisFine 2023-10-8 13:06
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