在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜全文
收藏本版 (113) |订阅

IC验证讨论 今日: 0|主题: 6952|排名: 16 

[求助] vcs编译出错,用-full64命令后无法生成simv文件  ...2 dongmingyang 2016-5-24 1614523 gerry1812 2024-2-3 14:24
[求助] systemverilog DUT代码使用verdi看信号波形问题 许learner 2024-2-1 61267 gerry1812 2024-2-3 14:21
[原创] 在定义验证代码中变量的bit和logic类型时,对仿真会产生哪些影响呢? 新人帖 桂花酒 2024-2-2 01146 桂花酒 2024-2-2 17:52
[求助] verdi启动不了 诸葛小天 2020-8-20 23676 nianhai1212 2024-2-2 16:55
[求助] 现在大家主要用的是uvm1.2还是1800.2 851018986 2024-1-17 41405 时之沙 2024-2-2 14:59
[求助] 二进制数据写入文件 ICJJ 2024-1-31 11047 veryIC 2024-2-1 10:43
[求助] 写二进制数据文件 ICJJ 2024-1-29 81345 liuguangxi 2024-2-1 09:53
[求助] vcs报错member not found icstudywsq 2024-1-29 31411 gaurson 2024-1-30 17:48
[求助] s家的test suite和普通的vip有什么区别 masscqz 2024-1-2 42593 saipolo 2024-1-29 16:59
[求助] fsdb怎么带有libcell中的信号波形 花伴星空 2024-1-5 52523 idealm 2024-1-29 16:40
[解决] VCLP怎样用verdi打开 freemanhans 2022-12-8 92984 创芯101 2024-1-29 15:24
[求助] 关于类的使用中this的用法 icstudywsq 2024-1-24 21165 popkok 2024-1-27 20:23
[原创] SV中随机句柄的使用 hithust 2024-1-23 11397 aa511950071 2024-1-25 11:35
[求助] UVM clone, 如果两个成员句柄指向同一个对象, 只能复制其中一个 新人帖 liutang2010 2023-10-22 72225 tk66 2024-1-22 10:22
[求助] mordport会用到吗? zhuimeng2020 2023-11-8 71493 tk66 2024-1-22 10:05
[求助] I2C的Clock synchronization和Arbitration突然搞不懂了? 误入百花深处 2024-1-21 01206 误入百花深处 2024-1-21 00:20
[求助] vcs2012支持在verdi中单步调试吗,help里只有-gui,但这个只能启动dve xshangyong 2018-7-30 63694 wojiaobuzhidao 2024-1-20 15:23
[原创] Verilog/SystemVerilog Setup in Vim 新人帖 AlvinRolling 2024-1-10 21301 yuanpin318 2024-1-18 20:19
[原创] 有没有人一起拼路科v3的课? BananaSuper 2024-1-5 72812 Johnmc104 2024-1-18 16:06
[求助] TSMC Flash IP 的使用问题  ...2 wuxiuying18 2018-11-16 1410142 j635 2024-1-17 14:39
[原创] Flash的Block Erase Command的地址信息代表的是字节吗? 误入百花深处 2024-1-16 21183 误入百花深处 2024-1-17 12:34
[求助] 寄存器模型配置DUT寄存器问题,谢谢大家 新人帖 起个名字好难啊 2024-1-10 21116 851018986 2024-1-17 10:53
[原创] synopsys的axi4总线的vip分配slave空间 静默有时 2023-12-4 21494 kang98253 2024-1-13 11:38
[求助] 新人求助,想要使用dve查看波形时为什么选择不了信号? icstudywsq 2024-1-7 11367 AlvinRolling 2024-1-11 19:34
[原创] iverilog对sv语法支持真的很差 erwang 2023-12-25 41552 ustszl 2024-1-11 15:36
[求助] VCLP读取网表时报错如何解决 - [悬赏 36 信元资产] SGengiant 2024-1-9 01392 SGengiant 2024-1-9 17:23
[求助] xcelium仿真怎么使用vcs加密的代码? zhiwenhao 2024-1-8 31621 zhiwenhao 2024-1-9 16:32
[求助] vcs编译命令——时间参数模型 BellaYang 2024-1-5 22554 BellaYang 2024-1-8 09:05
[讨论] sv或者UVM如何与python进行交互  ...2 芯游天下 2023-12-22 143612 nativeda230 2024-1-6 21:09
[求助] 提前结束仿真,导致fsdb文件用verdi打不开 新人帖  ...2 xsz_123 2023-11-1 124018 wupeijing654 2024-1-5 09:52
[求助] verdi查看信号波形问题 新人帖 Ellison 2023-12-2 31853 wupeijing654 2024-1-5 09:49
[求助] 为什么使用vcs仿真指定TESTNAME不管用? 新人帖 icstudywsq 2023-12-31 41264 wupeijing654 2024-1-5 09:39
[求助] Ralgen启动报错 - [已解决] hjacky2010 2017-10-25 35471 江小白! 2024-1-4 23:03
请教modelsim读宏定义文件的问题 carefree 2009-6-3 58878 xdf666 2024-1-4 15:17
[求助] Cadence VIP eth有支持思科QSGMIII spec吗? 新人帖 - [悬赏 10 信元资产] clivia.cai 2023-12-28 21425 clivia.cai 2024-1-4 14:12
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

X

手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 ) |网站地图

GMT+8, 2025-11-15 09:18 , Processed in 0.015271 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块