在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜帖子
[转贴] 杂谈:跨时钟域(CDC) - 如何让信息可预测 fiser 2021-3-12 02767 fiser 2021-3-12 11:44
[求助] 多输入逻辑门 AlexaGreen 2021-3-10 23670 ICS 2021-3-12 10:01
[求助] 关于DC和ICC线网延迟计算模型问题 新人帖 crazyhah 2021-3-11 42140 crazyhah 2021-3-12 09:57
[求助] Spdif 传输速率以及音频数据传输带宽 新人帖 zhenzhenhua 2021-3-11 01793 zhenzhenhua 2021-3-11 17:59
[求助] 有将C++算法转化为Verllog代码经验的高手请进  ...23 psd0208 2011-8-29 2116641 lewispoiuy 2021-3-11 14:02
[求助] 用88E1111实现千兆以太网和SFP通信的问题 zhubaojun 2011-8-18 921769 zfcswd 2021-3-11 11:39
[讨论] SDRAM和DDR2控制器编写  ...234 cpagm@qq.com 2015-7-9 3216697 lyflying 2021-3-11 10:41
[求助] 求助:如何用FPGA来验证AFC(自动频率控制)  ...2 yic2000 2012-6-25 105341 S10062140358 2021-3-11 10:16
[求助] Design Compiler 到IC Compiler 流程問題  ...2 leesg 2010-6-21 1710028 zhwps 2021-3-11 09:39
[求助] 请问SV中实例化后面(.*)是什么意思 新人帖 xiaocanjia 2021-3-8 22108 my2817 2021-3-11 09:34
[求助] 关于FPGA中高速DAC和DDS的问题 feiyuzhuxian 2016-10-26 44814 黑桃ACE 2021-3-10 21:41
[求助] 门控时钟能实现占空比为50%的8分频吗? dqwuf2008 2021-3-10 01852 dqwuf2008 2021-3-10 16:15
[讨论] vivado传参 hitten 2021-3-8 63988 hitten 2021-3-10 09:37
[求助] synopsys coreConsultant 使用讨论 xjmillie 2013-7-18 511947 pollaris 2021-3-10 09:22
[解决] 参数化的位宽 user123random 2018-3-9 43399 shu_hlq 2021-3-10 01:47
[求助] 游标卡尺型TDC的延迟理论上不是能做的很小吗?什么限制了精度 阿斯siur 2021-3-9 02013 阿斯siur 2021-3-9 15:05
[求助] 怎样快速看懂一个较大的verilog模块代码  ...23 fjmwu 2012-8-20 2315691 兵熊熊一窝 2021-3-8 17:59
[求助] input_delay和ouput_delay在顶层有pad的情形下如何设置 zhang113 2021-3-3 42179 zhang113 2021-3-6 12:09
[原创] BUFG的驱动能力 谁枫而飘 2021-3-5 03369 谁枫而飘 2021-3-5 22:36
[求助] 关于奇数分频电路的毛刺问题  ...23 songzijian87 2012-10-8 2616280 rvisk 2021-3-5 17:54
[求助] ISE中 ILA IP核增加观测信号后,时序不符合要求 come_on_sn 2021-3-5 01725 come_on_sn 2021-3-5 09:14
[求助] altera的quartusII中在进行时钟约束的时候set_clock_groups选择asynchronous或者exclusive是不是都一样 851018986 2021-3-3 12034 gaurson 2021-3-4 19:29
[原创] 芯片降压后的未解之谜:hold的罪过吗? 新人帖 lichangyun 2021-3-3 63530 lichangyun 2021-3-4 16:07
[原创] 请问有没有关于比特币矿机的硬件设计降低功耗的文件跟软件调试知识教程 谢谢你我的哥 2020-3-31 32547 zzj0329 2021-3-4 13:04
[原创] Verilog基本电路设计之四(去抖滤波) 精华3  ...234 杰克淡定 2016-6-20 3534033 jfeta 2021-3-4 08:27
[原创] 跑前仿真报错 bhd740 2018-2-3 78346 tanghaihua 2021-3-3 17:54
[求助] 数字IC设计,状态机用的多吗 lk1210 2021-3-2 62652 SophiaCheng 2021-3-3 15:15
[求助] leakage power的问题 新人帖 bingw0105 2021-3-2 02015 bingw0105 2021-3-2 19:00
[求助] 关于后仿真 logue 2021-3-2 02039 logue 2021-3-2 14:45
[求助] FPGA查看routing resources多出来的是什么鸭 Arthurjlin 2021-3-1 22332 Arthurjlin 2021-3-2 13:59
[求助] Verilog中自定义一个函数 实现统计7bit输入信号中1的个数的功能  ...23 come_on_sn 2021-1-14 249326 黑桃ACE 2021-3-1 22:06
[求助] 如何根据伪代码画出正确的datapath和状态图? zjulsh 2016-4-22 53967 a8750110 2021-3-1 22:04
[原创] AEC-Q100-009 ELECTRICAL DISTRIBUTIONS ASSESSMENT tomyang2008 2016-10-21 34426 a8750110 2021-3-1 21:57
[讨论] 为什么DFT中不把复位寄存器加入到扫描链中? IC菜鸟无敌 2021-2-22 105122 IC菜鸟无敌 2021-3-1 15:45
[求助] 如何在ARM官网上下载UMC工艺库 52927605@qq.com 2021-3-1 02119 52927605@qq.com 2021-3-1 14:35
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条


手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-8-22 22:25 , Processed in 0.027111 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块