EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子）› 数字IC设计【ASIC|IC前端|FPGA】› 数字IC设计讨论(IC前端|FPGA|ASIC)

数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 2 |主题: 31188|排名: 55

版主: shiyinjita, guofu2010, acgoal, chinafpga, dlb05061131, neoitachi, tangyutao, yadog, everhappy, HADIST, chevroletss, arthur_wang_orz, wanghl_beijing

1 ... 549 550 551 552553554 555 556 ... 892 / 892 页下一页

返回发新帖

新窗全部主题最新热门热帖精华更多		作者	回复/查看	最后发表


[求助] 请问在verilog中这两种写法的区别？ ...2	bomb_2009 2012-4-4	124968	最后的和弦 2013-1-11 09:28
[原创] ISE13.4开始支持SystemVerilog了么？ ...2	goalyoung 2012-5-5	116084	最后的和弦 2013-1-11 09:24
[求助] FPGA学习之路	gxiaob 2012-6-13	45464	最后的和弦 2013-1-11 09:22
[求助] xilinx芯片的时序约束问题	floydz 2012-4-25	43478	最后的和弦 2013-1-11 09:05
[讨论] 讨论一下专做FPGA的问题！ ...2 3	asyou 2012-1-10	217099	最后的和弦 2013-1-11 09:04
[讨论] 哪里能下到doulos的另外几本golden reference guide ？	tedazsx 2012-3-10	34987	liuyongchong 2013-1-10 23:12
[求助] 求助：verilog仿真，编译没错，仿真error loading design	小小舟 2013-1-8	45934	小小舟 2013-1-10 21:59
[求助] 如何在硬件代码（RTL）的层面去评估系统的负载	fiysben 2013-1-8	52823	shiyinjita 2013-1-10 21:54
[求助] 怎么手动配置slice？xilinx的	284294022 2013-1-9	12402	shiyinjita 2013-1-10 21:52
[求助] chipscope中为什么好多信号都没有呢，高手请进！	wxxhn 2011-2-15	46143	shiyinjita 2013-1-10 21:48
[求助] 门控时钟中的latch能不能替换成flip-flop	angangang3484 2013-1-10	32650	zhaichunhua168 2013-1-10 21:35
[求助] 请问两路串行数据的去毛刺一般怎么处理 ...2	arccosx 2013-1-5	129380	arccosx 2013-1-10 21:16
[原创] FPGA前端设计和后端设计各做什么工作？	liujian_2009 2012-8-4	95231	tiangua 2013-1-10 20:58
[原创] xilinx “out”偏移约束	xayaya 2013-1-9	33612	xayaya 2013-1-10 16:59
弱弱地问哈！HSPICE的网表是用什么编辑的啊？ ...2	Peter1008 2006-11-19	158346	winewoif 2013-1-9 23:25
[求助] 我在安装synopsys 软件的时候遇见的问题，请教一下，求解。。。	xiehk 2013-1-9	22730	xiehk 2013-1-9 21:43
[原创] xilinx “out”偏移约束	xayaya 2013-1-9	02746	xayaya 2013-1-9 18:01
[求助] 有没有工具转换 xilinx coe 为mif格式，每次用core generate 麻烦	yangchao1t 2013-1-8	18276	mymemory 2013-1-9 17:50
[求助] ise 14.2 core generate 产生rom总说rom模块重定义,请问怎么回事?	yangchao1t 2013-1-8	13251	mymemory 2013-1-9 17:47
[原创] 请教上拉电阻模块的用法？	atlandis 2013-1-8	11882	mymemory 2013-1-9 17:44
[求助] 怎么才能快速定位代码里面的if对应的else?	toby4111981 2013-1-9	15694	mymemory 2013-1-9 15:40
[求助] 关于ISE里面的MCB	kaiseradler 2012-11-21	52724	林煦韶 2013-1-9 14:11
[转贴] 电子工程师毕业3年，工资从5k到20k的经历 ...2 3 4 5 6	xuanjian 2011-2-24	5622320	林煦韶 2013-1-9 14:07
[求助] 关于跨市钟域	zz_3070 2013-1-8	42845	zz_3070 2013-1-9 09:58
[求助] system verilog的疑问	gg9132qq 2011-2-21	73321	最后的和弦 2013-1-9 09:00
[求助] viewdraw使用求助，谢谢	qingshang210 2013-1-8	05986	qingshang210 2013-1-8 23:28
[原创] ISE综合后RTL图错误	lantern5566 2012-9-20	97930	1559638992 2013-1-8 22:42
[原创] 请教例化pad	atlandis 2013-1-7	57588	lingyunmu666 2013-1-8 21:11
[求助] 用hspice仿电路功耗，掉电状态怎么设置啊？	lingyunmu666 2013-1-7	23784	lingyunmu666 2013-1-8 21:00
[求助] 求助：vhdl和verilog的时钟沿采样传输数据问题 ...2	ksqnhm 2013-1-5	1110767	llt_miaomiao 2013-1-8 19:45
[求助] ISE中的RTL schematic？	asin28 2012-12-13	45346	1559638992 2013-1-8 19:32
[讨论] set_load问题请教	sh_0119 2010-3-24	55000	dkjhl623 2013-1-8 14:26
请教有关set_drive和set_load的问题?	yifan225 2005-11-9	26195	dkjhl623 2013-1-8 14:24
[求助] 同步复位和异步复位	Gary.wang 2013-1-6	62425	Gary.wang 2013-1-8 12:13
[讨论] FPGA来控制CH375读写	navy1223 2012-4-11	22651	ic-designer 2013-1-8 11:07

1 ... 549 550 551 552553554 555 556 ... 892 / 892 页下一页

返回发新帖

账号		自动登录	找回密码
密码			注册

数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 2 |主题: 31188|排名: 55

快速发帖

浏览过的版块

站长推荐 /1