数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 31359|排名: 11

版主: yadog, everhappy, chevroletss, shiyinjita, chinafpga, dlb05061131, guofu2010, acgoal, neoitachi, arthur_wang_orz, tangyutao, wanghl_beijing, HADIST

1 ... 312 313 314 315316317 318 319 ... 896 / 896 页下一页

新窗全部主题最新热门热帖精华更多		作者	回复/查看	最后发表


[求助] synosys dc 不能启动图形界面	twaner 2016-9-27	02808	twaner 2016-9-27 10:14
[求助] xilinx逻辑分析仪chipscope抓取信号问题	flyamo 2012-8-9	96262	fkl523 2016-9-26 22:14
[求助] xilinx v5 PCIe核的使用	jazz850410 2014-1-8	75368	tazngxi 2016-9-26 20:39
[求助] 请问有谁用过JPEG2000压缩的ADV212芯片	lbrhust_2016 2016-9-26	01874	lbrhust_2016 2016-9-26 17:24
哪位能解释一下几种状态机设计时的编码方法吗？ ...2 3 4 5 6	bigboss 2003-11-28	5425928	ilovinit 2016-9-26 16:21
[原创] 遇到个很尴尬的问题，求指教	atlandis 2016-9-24	42660	iidestiny 2016-9-26 15:05
[求助] 源同步（source synchronous）的outputconstraint	xiangpeis 2016-9-24	45009	xiangpeis 2016-9-26 14:31
[求助] 请问各位前辈，调试设计的FPGA电路，需要什么设备？	札阑丁 2016-9-24	32207	fascinate_lyd98 2016-9-26 11:28
[求助] 我无语了，求高手	djqlyy 2016-9-23	74142	djqlyy 2016-9-25 11:23
[求助] 请教关于时序的问题 ...2	谁枫而飘 2016-9-21	145071	谁枫而飘 2016-9-25 10:34
[求助] set_multicycle_path可用为0吗	谁枫而飘 2016-9-24	12154	谁枫而飘 2016-9-25 10:23
有关ISE仿真	crazy2002 2004-6-26	83771	zhaoliang3924 2016-9-24 11:39
[求助] verilog写的门级d触发器做2分频用modelsim和ise仿真都无法出现波形	lulu1130 2015-2-24	43613	zhaoliang3924 2016-9-24 11:27
[求助] LED-PWM调制	黎释注册 2016-9-24	03071	黎释注册 2016-9-24 08:46
[求助] 用FPGA做的DDS有毛刺 ...2	kandy286 2013-12-26	117202	schottky163 2016-9-23 22:52
两个时钟clka,clkb，通过sel信号2选1。处理方法探讨。 ...2	hamham_ww 2009-8-31	1113679	schottky163 2016-9-23 22:36
[求助] 请教一个关于k7 fpga multiboot的问题 - [悬赏 300 信元资产]	xduryan 2016-9-21	14335	xduryan 2016-9-23 20:43
[讨论] 如何让ISE根据约束自动添加iodelay来满足时序关系	挂在天边的鱼 2013-10-11	86318	谁枫而飘 2016-9-23 20:30
[求助] VHDL编程问题 - [悬赏 5 信元资产]	kayjoa 2016-9-23	03477	kayjoa 2016-9-23 20:01
[求助] 用ise和modelsim做系统时序仿真，单比特数据的问题	zhaoliang3924 2016-9-23	22967	zhaoliang3924 2016-9-23 18:39
[原创] 请教个小问题	atlandis 2016-9-21	33536	atlandis 2016-9-23 18:00
[求助] 代码求助!!!!!!!!	as0920 2016-9-20	64082	刘美瑶 2016-9-23 17:24
[求助] DDR3在write leveling步骤出错	xxrw2007 2016-7-1	84783	xxrw2007 2016-9-23 15:41
[求助] 光纤自环收数问题	昶橙子 2016-9-23	02293	昶橙子 2016-9-23 15:33
[资料] verilog培训教程 ...2	cccoccc 2009-12-26	126638	QQben 2016-9-23 14:32
[求助] ISE引出时钟信号时报错	silverwolfman 2016-9-23	34242	bjutzhang 2016-9-23 13:59
[求助] 在算式里先用乘法在用除法最后的结果错误为什么	4746500 2016-9-22	21076	4746500 2016-9-23 11:08
[讨论] 前几天MTK面试题，两DFF中间加LATCH，分析建立保持时间？恳请大神指点 ...2	hiwzy 2016-9-20	118049	又是一个号 2016-9-23 10:26
[求助] 求一个DDR的控制器例子 ...2	1072978274 2014-9-12	108885	荒漠小草 2016-9-23 09:43
[求助] 求教熟悉xilinx IOB的大神 - [已解决]	xduryan 2016-9-22	33233	xduryan 2016-9-22 19:38
[求助] FPGA 笔试题目	jiang-- 2016-9-22	02587	jiang-- 2016-9-22 19:21
[解决] ISE综合时inout信号被优化掉	daneast 2016-9-13	33735	atomdust 2016-9-22 17:41
[求助] xilinx反相器的实现 - [悬赏 100 信元资产]	xduryan 2016-9-22	12989	atomdust 2016-9-22 17:38
[资料] 分享一个有用的资料	nevio 2016-7-12	12575	xiaopingwl 2016-9-22 15:31
[资料] 明德扬分享--点拨FPGA视频 100个案例免费下载 ...2 3	panwm100 2015-9-18	2610178	xiaopingwl 2016-9-22 15:18

1 ... 312 313 314 315316317 318 319 ... 896 / 896 页下一页

返回发新帖

账号		自动登录	找回密码
密码			注册

数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 31359|排名: 11

快速发帖

站长推荐 /1