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[求助] 芯片的复位验证? recorner 2015-12-7 02356 recorner 2015-12-7 19:42
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[讨论] uvm 芯片中存在多个模块级联的情况,请问级联内部的信号怎么监测的? allencherry 2014-9-11 65044 Ameteur 2015-12-3 22:49
[求助] sentaurus 初学者 关于sde命令的一个问题 陈安妮 2015-9-7 13050 pnono 2015-12-3 21:21
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[转贴] fopen的使用,verilog也这么用 shuke 2010-2-3 512448 fqcybf 2015-12-2 14:53
[求助] sequence定义为参数话的类,uvm会报warning,当前的sequencer不知道和那个sequence连接 allencherry 2015-12-2 01642 allencherry 2015-12-2 08:27
[讨论] DDR3 DQS 测量到的信号的回沟比较大,跟那些原因有关 北極企鵝 2015-10-23 33631 lazybear 2015-11-30 10:22
[求助] ISE与questasim_10.1d联合仿真的问题。求教! ryl_1989 2015-11-30 02437 ryl_1989 2015-11-30 00:21
[求助] UVM疑问 白兴金 2015-11-27 42689 白兴金 2015-11-28 21:01
[求助] 怎么解决formality验证中BBPin unmatched yanpeace 2015-7-14 15773 SKILLER 2015-11-26 09:31
[讨论] Verilog VHDL 排版插件 luoyanghero 2015-11-24 22506 haitaox 2015-11-25 09:02
[求助] 用 nc_verilog跑波形的问题~ 芹菜饺子 2015-11-24 12010 zw84611 2015-11-25 06:59
[求助] 请问windows下用modelsim仿真怎么一次把所有信号的波形dump出来 spirit0302 2015-8-16 23411 王皓 2015-11-24 20:36
[求助] 使用systemverilog完成仿真时钟频率的自动调整 zhouyuwo 2015-11-20 63701 gaurson 2015-11-23 22:48
[求助] uvm_do 报错,说参数类型不匹配 roc2007 2015-11-13 73239 roc2007 2015-11-23 20:32
[求助] 有没有做过存储器内建自修复的 eda—wdy 2015-11-23 01469 eda—wdy 2015-11-23 19:29
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[求助] UVM+Vvhdl语言,经验求职 9065574912 2015-10-9 43316 zrzf23 2015-11-23 16:53
[求助] IC5141集成calibre - [悬赏 20 信元资产] fzu_physics 2013-10-9 22552 jeffej 2015-11-22 10:56
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