在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
楼主: jiull

[原创] Digital VLSI Chip Design with Cadence and Synopsys CAD Tools

[复制链接]
发表于 2021-12-15 12:25:22 | 显示全部楼层
发表于 2022-5-26 21:36:35 | 显示全部楼层
Thank you very much.
发表于 2023-9-4 12:40:57 | 显示全部楼层
Thanks for sharing.
发表于 2023-9-4 13:08:27 | 显示全部楼层
多谢分享
发表于 2024-1-11 01:23:44 | 显示全部楼层

Thanks for sharing
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

×

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-12-24 01:49 , Processed in 0.023972 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表