在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
楼主: jiull

[原创] Digital VLSI Chip Design with Cadence and Synopsys CAD Tools

[复制链接]
发表于 2019-11-18 09:51:54 | 显示全部楼层
Thank you for your share.
发表于 2019-11-18 15:47:49 | 显示全部楼层
很好的资料,多谢分享
发表于 2019-12-21 08:41:57 | 显示全部楼层
thanks a lot
发表于 2019-12-21 14:42:12 | 显示全部楼层
非常感谢
发表于 2019-12-31 14:11:25 | 显示全部楼层
找這本很久了
发表于 2020-1-6 16:30:54 | 显示全部楼层
感谢楼主的分享,谢谢!
发表于 2020-8-17 20:26:24 | 显示全部楼层
谢谢楼主!
发表于 2020-8-18 08:09:18 | 显示全部楼层
感谢
发表于 2020-8-18 09:25:57 | 显示全部楼层
Thanks for sharing
发表于 2020-8-24 11:33:59 | 显示全部楼层
Thanks for sharing.
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

×

小黑屋| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-4-28 12:56 , Processed in 0.026682 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表