设为首页收藏本站

eetop公众号

创芯大讲堂

创芯人才网

切换到宽版

手机号码，快捷登录

创芯云服务 : 创芯大讲堂 | 创芯人才网 | 数字IC职业培训 EETOP诚邀线上IC培训讲师!

搜帖子

EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › Digital VLSI Chip Design with Cadence and Synopsys C ...

1 2 3 456 7 8 9 10 / 10 页下一页

发新帖

楼主: jiull

[原创] Digital VLSI Chip Design with Cadence and Synopsys CAD Tools

发表于 2018-10-9 14:40:45 | 显示全部楼层

回复 1# jiull
非常感谢分享

回复支持反对

发表于 2018-10-16 19:04:24 | 显示全部楼层

谢谢分享！

EETOP创芯人才网职位发布入口

回复支持反对

发表于 2018-10-20 19:49:30 | 显示全部楼层

good share

回复支持反对

发表于 2018-11-13 16:14:06 | 显示全部楼层

谢谢分享

EETOP创芯人才网职位发布入口

回复支持反对

发表于 2018-11-30 13:42:26 | 显示全部楼层

感谢分享

EETOP创芯人才网简历投递入口

回复支持反对

发表于 2019-1-15 16:00:57 | 显示全部楼层

thanks

EETOP创芯人才网职位发布入口

回复支持反对

发表于 2019-1-15 16:01:41 | 显示全部楼层

thanks

EETOP创芯人才网简历投递入口

回复支持反对

发表于 2019-3-9 13:31:38 | 显示全部楼层

回复 1# jiull

EETOP创芯人才网职位发布入口

回复支持反对

发表于 2019-3-9 21:43:19 | 显示全部楼层

不错，谢谢！

EETOP创芯人才网简历投递入口

回复支持反对

发表于 2019-3-12 09:40:14 | 显示全部楼层

great book, thank you for sharing this book.

回复支持反对

1 2 3 456 7 8 9 10 / 10 页下一页

发新帖

高级模式

B Color Image Link Quote Code Smilies

您需要登录后才可以回帖登录 | 注册

本版积分规则回帖后跳转到最后一页

关闭

站长推荐 /2

小黑屋| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号京公网安备:11010502037710 )

GMT+8, 2024-4-28 23:17 , Processed in 0.027818 second(s), 6 queries , Gzip On, Redis On.

eetop公众号

创芯大讲堂

创芯人才网

快速回复 返回顶部 返回列表