在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
楼主: jiull

[原创] Digital VLSI Chip Design with Cadence and Synopsys CAD Tools

[复制链接]
发表于 2020-11-29 12:11:35 | 显示全部楼层
good book.
发表于 2020-12-4 01:48:40 | 显示全部楼层
thanks
发表于 2021-2-7 20:49:13 | 显示全部楼层
thaks for shaing
发表于 2021-2-13 07:56:06 | 显示全部楼层
感谢
发表于 2021-4-8 01:43:47 | 显示全部楼层
thanks a lot
发表于 2021-4-12 13:23:35 | 显示全部楼层
thank you for share
发表于 2021-4-13 20:42:55 | 显示全部楼层
thanks for sharing
发表于 2021-4-16 20:04:22 | 显示全部楼层
thanks for sharing
发表于 2021-12-14 05:41:14 | 显示全部楼层
thanks
发表于 2021-12-14 05:44:38 | 显示全部楼层
thanks for sharing
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条


小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-22 09:46 , Processed in 0.022212 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表