在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
讨论区只允许讨论交流不允许上传资料,更不允许任何形式的灌水!
公告 公告: 大附件建议上传在云盘,然后分享链接(可以自行设定下载积分) jackzhang 2024-2-27    
全局置顶 隐藏置顶帖 低功耗芯片设计研讨会 | 5.29上海、6.5武汉、6.12深圳(免费 参会有好礼) attach_img jackzhang 2024-5-16 43661 liudmgo 前天 14:27
全局置顶 隐藏置顶帖 忆阻器、第三代半导体等半导体材料与器件讲坛(资料+视频) jackzhang 2024-3-8 013263 jackzhang 2024-3-15 09:26
全局置顶 隐藏置顶帖 ISSCC2024 Session Digest PPT Short-Course  ...23456 james2007 2024-2-23 5230345 xder4213 2024-5-16 11:36
全局置顶 隐藏置顶帖 创芯大讲堂新课上线《DFT 设计与实现》限时75折 attach_img 创芯讲堂运营 2023-11-15 814694 hzmscut 5 天前
      
[求助] 菜菜捞捞(关于clk上升沿触发块的执行先后问题) 新人帖 attach_img New 关东煮游泳 昨天 22:19 157 关东煮游泳 昨天 22:27
[讨论] vivado的综合 New scutlee 昨天 16:10 023 scutlee 昨天 16:10
[求助] 微电子科班做数字较非科班有什么优势? New danalog 昨天 12:31 5174 小鸟探戈 昨天 14:53
[求助] FPGA New UHYGVYUUYV 昨天 09:58 069 UHYGVYUUYV 昨天 09:58
[求助] VCS 2020.12版本安装 新人帖 New Jackyanguan 昨天 09:28 028 Jackyanguan 昨天 09:28
[求助] FPGA约束文件 New 方出旭旭 前天 14:18 181 ee_wang7788 前天 17:00
[求助] vcs+verdi联合仿真最长时间可设置多少 新人帖 New mmoooon 前天 13:06 179 gaurson 昨天 18:49
[求助] synplify XMR cross module reference 生成了black box New icdv_后生 3 天前 054 icdv_后生 3 天前
[原创] 求一篇论文 attachment New takeshineshiro 6 天前 1151 aiolos65 5 天前
悬赏 [求助] 求助cordic代码 新人帖 - [悬赏 50 信元资产] New 毛毛球 6 天前 0184 毛毛球 6 天前
[资料] CICC2024下载连接 attachment New mininote2133 6 天前 8309 nfhfymrf 3 天前
[讨论] 不加时序约束的综合和加时序约束的综合面积应该差多少?? New scutlee 6 天前 4169 scutlee 昨天 16:05
悬赏 [求助] ICC2: datapath delay相关问题 - [已解决] attachment New Pacific-Feng 6 天前 6188 Pacific-Feng 昨天 13:16
悬赏 [求助] design compiler 合成相關問題 - [已解决] New Pacific-Feng 7 天前 4159 OsrisGZY 6 天前
[讨论] 汽车电子功能安全中锁步方式、故障处理方式讨论 New 点灯小能手 7 天前 2130 点灯小能手 3 天前
[求助] genus 综合 reset fanout问题 New tomyang2008 7 天前 3119 zero_0 5 天前
[求助] APB总线仿真 attach_img New zhanghanqing 7 天前 7173 gaurson 5 天前
[求助] binary to thermometer decoder设计 wayward 2024-5-21 0127 wayward 2024-5-21 20:33
[讨论] ICG怎么样插入?? scutlee 2024-5-21 7200 869053983 5 天前
[讨论] FPGA 的IOBUF和clock BUF scutlee 2024-5-20 1117 774110102 2024-5-21 13:30
[资料] 苏黎世联邦理工 ETH Zurich:Digital Design and Computer Architect 新人帖 attachment Jinkui 2024-5-20 3219 A1985 2024-5-21 16:58
[求助] 新人请教关于design_vision软件问题 新人帖 attach_img zr0243 2024-5-20 0194 zr0243 2024-5-20 08:19
[讨论] vivado的clk_wiz scutlee 2024-5-18 2148 scutlee 5 天前
[讨论] vivado时序违例 scutlee 2024-5-17 3200 scutlee 2024-5-20 16:08
[讨论] vivado出现时序违例 scutlee 2024-5-17 0109 scutlee 2024-5-17 22:29
[原创] NVMe over PCIe 逻辑加速引擎 attach_img xianuser 2024-5-17 1189 xidianuser 2024-5-20 08:06
[讨论] 一片FPGA芯片能例化几个ILA,MMCM,PLL和VIO?????? scutlee 2024-5-17 1134 Wade_ 2024-5-17 17:53
[资料] Cortex M0 + USB2.0 IP SOC设计例程 attach_img dodoee 2024-5-17 2328 kk2009 2024-5-19 06:06
[讨论] 多少bit的寄存器加ICG比较好?? scutlee 2024-5-17 0150 scutlee 2024-5-17 15:19
[讨论] FPGA的GPIO scutlee 2024-5-16 7302 ee_wang7788 2024-5-20 10:04
悬赏 [求助] 请问我用蒙特卡洛仿真,单独仿真OTA失配和加上斩波后OTA失配不变是什么原因呢? - [悬赏 30 信元资产] intentydh 2024-5-16 1270 intentydh 5 天前
[求助] ICG综合时序违约 南波湾001 2024-5-16 2183 darlingwqm 2024-5-20 08:35
[求助] fpga 新人帖 UHYGVYUUYV 2024-5-16 6215 UHYGVYUUYV 昨天 10:50
[讨论] vivado 的ILA不在最顶层例化可以吗 scutlee 2024-5-16 1141 waniwa 2024-5-16 19:42
[求助] synplify SCOPE编辑fdc约束文件无法设置针对子module的约束 h2o_freely 2024-5-16 2105 h2o_freely 2024-5-16 17:28
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

×

小黑屋| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-5-29 07:53 , Processed in 0.069399 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块