数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 18 |主题: 31294|排名: 8

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报名	shasd 2003-11-3	02428	shasd 2003-11-3 12:34
片内振荡器。	dairlom 2003-10-22	74726	atuhappy 2003-11-3 12:04
[公告]联盟长期接受报名	bravelu 2003-10-31	12716	ameicjm 2003-11-3 11:18
cpld芯片同时接两个不同时钟，是否可以？	fanqiongjian 2003-11-3	24520	fanqiongjian 2003-11-3 09:42
signal timer : signed(15 downto 0);是什么意思？	洋洋 2003-11-2	55549	洋洋 2003-11-3 08:57
各位高手，7128的输出电流最大可以到多少？我希望每个脚输出10MA	SYARD001 2003-10-20	54040	bravelu 2003-11-2 22:54
[公告]IP设计联盟第一阶段报名截止	bravelu 2003-11-2	02499	bravelu 2003-11-2 11:57
各位前辈，把我也算上吧！	dairlom 2003-11-1	15934	bravelu 2003-11-2 11:23
报名！	yunyt 2003-11-1	02266	yunyt 2003-11-1 20:18
[求助]SCAN信号时间问题	goodhope 2003-10-31	23318	老扁 2003-11-1 16:35
[求助]vhdl中的component怎么改写成verilog模块？	jiqing 2003-10-30	44825	goodhope 2003-11-1 12:12
同步fifo和异步fifo的区别 (无内容)	yn800323 2003-10-31	12523	cnspy 2003-11-1 09:56
我在UC里建了一个“ASIC工作室”。作为实时讨论，有人想试试吗？	cnspy 2003-11-1	02614	cnspy 2003-11-1 09:32
还是用cpld实现类似74LS74的逻辑关系的问题 ...2	fanqiongjian 2003-10-31	125506	fanqiongjian 2003-10-31 22:23
怎么样加入联盟呢？ (无内容)	yaoyaohu 2003-10-31	13662	bravelu 2003-10-31 20:29
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yybinliu	yybinliu 2003-10-31	12577	bravelu 2003-10-31 19:08
我报名拉	weiwu 2003-10-31	02551	weiwu 2003-10-31 19:00
坛主：能不能帮我看看	yn800323 2003-10-31	12245	yn800323 2003-10-31 18:05
是否可以用cpld实现类似74LS74的逻辑关系？ ...2	fanqiongjian 2003-10-28	155440	fanqiongjian 2003-10-31 16:49
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为什么上不了网？	3650054 2003-10-30	62765	greenpine 2003-10-31 11:16
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搭个末班车，报名，wsad1@sohu.com (无内容)	greenpine 2003-10-31	02850	greenpine 2003-10-31 11:06
搞cpld大家是不是从原理图到pcb到调试都是一个人啊？	zhoujj 2003-9-3	72906	catxdmm 2003-10-31 10:42
请教一下关于“signal is assigned but never uese”问题	zhuoyue 2003-10-30	65340	洋洋 2003-10-31 10:34
关于时钟	wilson 2003-10-30	33587	iamchine 2003-10-31 10:26
大家来讨论一下吧！	frankdsr 2003-10-30	53657	xjtanh 2003-10-30 22:33
fcnt_allow的含义	jiqing 2003-10-30	02946	jiqing 2003-10-30 21:45
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转载：FPGA制造工艺缩小到90纳米可编程逻辑应用扩展到消费电子	一声叹息 2003-10-30	63594	tonyliu76 2003-10-30 17:43
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用jtag头是否可以向同一cpld芯片重复下载更新的程序？ (无内容)	fanqiongjian 2003-10-30	12249	bravelu 2003-10-30 15:23
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