数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 7 |主题: 31357|排名: 8

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[公告]IP设计联盟第一阶段报名截止	bravelu 2003-11-2	02521	bravelu 2003-11-2 11:57
各位前辈，把我也算上吧！	dairlom 2003-11-1	15957	bravelu 2003-11-2 11:23
报名！	yunyt 2003-11-1	02285	yunyt 2003-11-1 20:18
[求助]SCAN信号时间问题	goodhope 2003-10-31	23342	老扁 2003-11-1 16:35
[求助]vhdl中的component怎么改写成verilog模块？	jiqing 2003-10-30	44845	goodhope 2003-11-1 12:12
同步fifo和异步fifo的区别 (无内容)	yn800323 2003-10-31	12543	cnspy 2003-11-1 09:56
我在UC里建了一个“ASIC工作室”。作为实时讨论，有人想试试吗？	cnspy 2003-11-1	02632	cnspy 2003-11-1 09:32
还是用cpld实现类似74LS74的逻辑关系的问题 ...2	fanqiongjian 2003-10-31	125548	fanqiongjian 2003-10-31 22:23
怎么样加入联盟呢？ (无内容)	yaoyaohu 2003-10-31	13678	bravelu 2003-10-31 20:29
[求助]	zhzero 2003-10-31	63081	bravelu 2003-10-31 19:22
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我报名拉	weiwu 2003-10-31	02570	weiwu 2003-10-31 19:00
坛主：能不能帮我看看	yn800323 2003-10-31	12265	yn800323 2003-10-31 18:05
是否可以用cpld实现类似74LS74的逻辑关系？ ...2	fanqiongjian 2003-10-28	155481	fanqiongjian 2003-10-31 16:49
[公告]联盟顾问招聘	bravelu 2003-10-18	63297	greenpine 2003-10-31 13:45
为什么上不了网？	3650054 2003-10-30	62785	greenpine 2003-10-31 11:16
setup/hold 时间的问题！	3650054 2003-10-24	93591	洋洋 2003-10-31 11:11
搭个末班车，报名，wsad1@sohu.com (无内容)	greenpine 2003-10-31	02859	greenpine 2003-10-31 11:06
搞cpld大家是不是从原理图到pcb到调试都是一个人啊？	zhoujj 2003-9-3	72926	catxdmm 2003-10-31 10:42
请教一下关于“signal is assigned but never uese”问题	zhuoyue 2003-10-30	65369	洋洋 2003-10-31 10:34
关于时钟	wilson 2003-10-30	33603	iamchine 2003-10-31 10:26
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转载：FPGA制造工艺缩小到90纳米可编程逻辑应用扩展到消费电子	一声叹息 2003-10-30	63606	tonyliu76 2003-10-30 17:43
[求助]为什么论坛提交数据失败？	jiqing 2003-10-30	02378	jiqing 2003-10-30 16:56
[求助]一些VHDL问题	jiqing 2003-10-30	23190	jiqing 2003-10-30 16:43
用jtag头是否可以向同一cpld芯片重复下载更新的程序？ (无内容)	fanqiongjian 2003-10-30	12262	bravelu 2003-10-30 15:23
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