数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 5 |主题: 31230|排名: 9

版主: yadog, everhappy, chevroletss, shiyinjita, chinafpga, dlb05061131, guofu2010, acgoal, neoitachi, arthur_wang_orz, tangyutao, wanghl_beijing, HADIST

1 ... 168 169 170 171172173 174 175 ... 893 / 893 页下一页

新窗全部主题最新热门热帖精华更多		作者	回复/查看	最后发表


[求助] ISE map中的错误	110500623 2011-2-9	38028	omidi.g.r 2020-5-24 22:50
[求助] FPGA时钟端口引不出来	小TWO崽子 2020-5-23	12420	asic_service 2020-5-23 21:51
[原创] 芯片行业的收入情形是什么样? ...2	changxusu 2020-2-14	1911281	tezhong 2020-5-23 18:43
[求助] FPGA和SOC项目 - [悬赏 200 信元资产]	keebope 2020-5-20	53335	keebope 2020-5-23 13:26
[求助] DC partion 问题	494693243 2020-5-22	22644	omityoung 2020-5-22 22:07
[求助] QUARTUS功能不全，缺少EDA tools option，无法调用modelsim进行仿真	qzzhang 2020-5-22	35004	qzzhang 2020-5-22 18:20
[招聘] 厦门寻求模拟IC设计大神	zhangxin6886 2020-5-12	22799	yyp_123 2020-5-21 17:58
[原创] 敝人敝见精华1 ...2 3 4	zhq415758192 2012-10-23	3731055	ever4ever 2020-5-21 16:39
[求助] verilog port 问题 ...2	494693243 2019-10-10	154855	494693243 2020-5-21 14:20
[求助] 请教FPGA综合(synplify工具) 时钟约束	frankelly 2019-5-27	34035	liyu266 2020-5-21 10:29
[活动] H.265(HEVC)编码器IP开发组队，资深数字IP设计工程师带你飞 ...2 3	asic_service 2019-5-13	218513	randolpha 2020-5-20 08:21
[求助] Spyglass skip_platform_check	ziven 2019-12-6	23536	tandd 2020-5-19 16:35
[资料] 数字前端最新视频教程，license到期解决，新版软件分享，模拟版图视频资料	balance0 2020-1-4	63374	J793306869 2020-5-19 15:01
[原创] sinc和cic滤波器有关系吗？	bkhzw6 2016-8-2	14100	haitang123 2020-5-19 12:33
[求助] 对于先进工艺制程，数字IC设计需要考虑哪些方面的因素呢？	梦凝霜 2019-10-3	22565	mabin99 2020-5-19 10:05
[求助] 非阻塞赋值语句请教	freebigfish 2020-5-17	42582	freebigfish 2020-5-19 08:41
[原创] altclkctrl这个ip出来的时钟，如何约束？	american007 2020-5-19	02941	american007 2020-5-19 04:22
[求助] 请问论坛哪位大侠有Quartus_II 15可下载?谢谢	jx_0009 2015-7-2	11845	crueler 2020-5-18 21:15
[原创] 高速数据采集问题	arsenal1215 2020-5-18	03328	arsenal1215 2020-5-18 15:47
[原创] 高性能数据存储板学习资料：基于6U VPX 的mSATA高性能数据存储板	orihard1 2020-5-18	02594	orihard1 2020-5-18 11:25
[求助] 一个不小心导致的隐秘的组合逻辑环 ...2	YoungZ1 2015-10-28	1712965	夏尔 2020-5-18 10:43
[求助] nand flash 仿真模型	tide 2014-7-1	75741	roghy_mar 2020-5-17 03:05
[求助] 关于模块划分，求高人指点	gatusokaka 2020-5-16	01829	gatusokaka 2020-5-16 09:04
[讨论] 这些常用IC设计网站，有哪些你熟悉的	chendiyi 2020-5-15	02695	chendiyi 2020-5-15 14:01
[求助] 新手，学习verilog还是直接上system verilog ...2	qinyuc 2019-10-5	106121	chendiyi 2020-5-15 13:51
[原创] 在Questa下面使用UVM (包括compile最新的uvm-1.1c) ...2 3 4	asic_service 2013-1-29	3118575	mailtoanoopbabu 2020-5-14 22:36
请您解释一下altera lpm_fifo_dc0中 wrusedw和rdusedw信号的含义	Jermaine618 2007-4-11	39981	15827552818 2020-5-14 13:35
[解决] 无	梅子酒 2020-5-14	04566	梅子酒 2020-5-14 11:57
同步时钟和异步时钟的优缺点在哪里？	lienking 2008-11-12	99424	mabin99 2020-5-14 10:53
[讨论] Verilog的赋值有什么用处，见下图	阳光夏向日葵 2019-11-26	32346	mabin99 2020-5-14 10:44
[求助] 新人请教一下testbench问题 - [已解决]	fangbbyl516 2020-5-14	32751	buzhou2006 2020-5-14 08:15
[求助] DDR2仿真模型错误	gxiaob 2012-6-9	64949	Hope801 2020-5-13 22:53
[求助] 并行nor flash操作问题，请大家指点	wangjun403 2020-1-13	22374	黑桃ACE 2020-5-13 21:52
[求助] 刚刚接触综合和后端，想请教一下相关eda的使用	洛伦兹不要变坏 2019-12-18	11947	mabin99 2020-5-13 17:07
[求助] DC综合时的width mismatch问题	andy89926 2019-12-25	66338	mabin99 2020-5-13 16:56

1 ... 168 169 170 171172173 174 175 ... 893 / 893 页下一页

返回发新帖

账号		自动登录	找回密码
密码			注册

数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 5 |主题: 31230|排名: 9

快速发帖

浏览过的版块

站长推荐 /1