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悬赏 [求助] 有没有vim自动补全类成员的插件啊 新人帖 - [悬赏 2 信元资产] a1872040489 2021-12-31 01991 a1872040489 2021-12-31 08:17
[求助] 内部wire线，需要从外部赋值 周嬷嬷 2021-12-23 92392 笃定 2021-12-30 18:17
[求助] UVM构造函数new的疑问，困扰一周了，先谢谢了  ...2 mil818 2016-3-19 1617879 许晴125 2021-12-30 17:30
[原创] Verilog通过PLI方式调用C函数，ACC报错，不知道有人碰到过吗 rvisk 2021-12-30 11408 saipolo 2021-12-30 11:35
[求助] Found 'interface' inside module before 'endmodule'. 'interface' inside 'module' is not yet supported. 新人帖 attachment 柳梢低头 2021-12-14 24723 柳梢低头 2021-12-29 15:48
[求助] EDAplayground波形仿真超时求解 新人帖 attach_img Stormbringer 2021-12-29 01726 Stormbringer 2021-12-29 15:29
[求助] VCS compile报错 attach_img wanghonglei7782 2021-12-26 62340 飞翔的马甲 2021-12-29 09:08
[求助] Calibre无法调virtuoso直接从原理图中导出网表 attach_img sober279 2021-12-27 21598 sober279 2021-12-28 12:59
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[求助] vc_vip_O-2018.09的ahb example求助 新人帖 attach_img haitang0001 2021-3-20 83437 haitang0001 2021-12-24 14:19
[求助] verdi uvm debug模式下的问题 attach_img  ...23 Ka2ken 2021-3-17 208297 qin2879 2021-12-23 15:20
[求助] design compiler 请问这个问题怎么解决？ attach_img yuyiccc1 2021-12-21 21735 夏尔 2021-12-23 15:15
[求助] 求助关于DFT插入扫描链的问题(RTL compiler 或Design Compiler) 新人帖 litianhong 2021-12-23 01364 litianhong 2021-12-23 12:31
[求助] 求助，如何用cadence对器件或电路进行噪声仿真？ 新人帖 guzhq 2021-12-13 11787 guzhq 2021-12-22 10:56
[求助] offer选择 新人帖 migu_hh 2021-12-4 62105 migu_hh 2021-12-21 16:51
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