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[求助] 如何复制提取verdi里环境源码 zhangdeshuai 2021-10-24 62413 zhangdeshuai 2021-10-31 21:11
[讨论] 测试点开发方法 新人帖 二十赫兹黑 2021-10-30 01287 二十赫兹黑 2021-10-30 15:13
悬赏 [求助] LVS又又又又又又出现错误了,饶了我吧... - [阅读权限 255]- [已解决] attach_img  ...2 北风1号 2021-10-28 131722 北风1号 2021-10-30 09:10
[原创] verification env demo v3 attachment  ...2 cofd0nut 2020-9-30 105779 steven_sun 2021-10-30 06:36
[求助] synopsy axivip如何開啟aruser awuser端口 新人帖 steven_sun 2021-10-27 41591 steven_sun 2021-10-29 20:27
[求助] 校招offer选择,关于触控与显示驱动IC前景 新人帖 rimuzhnegfan 2021-10-29 51797 飞翔的马甲 2021-10-29 16:45
悬赏 [求助] 问题解决了,自己犯傻了 新人帖 - [悬赏 50 信元资产] zobo1 2021-10-29 01725 zobo1 2021-10-29 10:17
悬赏 [求助] 关于vcs+xa,verilog作Top的仿真 - [悬赏 5 信元资产] attach_img noname丶 2021-10-29 01818 noname丶 2021-10-29 09:54
[讨论] 常用HDL仿真软件questasim,ncsim,vcs速度的比较  ...2 wuliao311 2015-5-29 1111752 yuanqidefeng 2021-10-29 09:24
悬赏 [求助] 一个有关ams仿真的问题 - [阅读权限 255]- [已解决] attach_img 北风1号 2021-10-15 4567 北风1号 2021-10-28 20:08
[求助] 求synopsys公司axi的相关资料 zuiqiangzhe 2019-6-29 62966 jingfanchanshi 2021-10-28 17:12
[原创] sequence向sequencer中送出transaction EDAStar 2021-10-22 61547 EDAStar 2021-10-28 14:37
悬赏 [求助] 画原理图的基础问题 - [阅读权限 255]- [已解决] attach_img  ...2 北风1号 2021-10-27 121666 北风1号 2021-10-28 14:19
悬赏 [求助] 一个很大的版图应该如果进行后仿真提参呢? - [阅读权限 255]- [已解决] attach_img 北风1号 2021-10-27 4485 北风1号 2021-10-28 10:54
[求助] UVM monitor监测问题 新人帖  ...2 猫猫猫 2019-10-26 116489 jingfanchanshi 2021-10-27 19:22
悬赏 [求助] 如何将添加好的model library保存成一个文件? - [阅读权限 255]- [已解决] attach_img 北风1号 2021-10-25 7501 eebbgao 2021-10-27 16:06
[原创] verdi 调用C model怎么查看指针地址的数据 hdl1016486425 2021-10-27 01564 hdl1016486425 2021-10-27 10:32
[求助] supertab插件怎么在gvim插入模式下自动列出来列表? allright0218 2021-10-25 41647 saipolo 2021-10-26 12:03
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[求助] gvim自动补全功能怎么安装? allright0218 2021-10-25 61850 saipolo 2021-10-25 18:15
悬赏 [求助] 画原理图时的label问题 - [阅读权限 255]- [已解决] attach_img 北风1号 2021-10-24 2524 billgolden 2021-10-25 09:26
[求助] vcs语法错误 新人帖 chinesebibi2 2021-10-21 31752 chinesebibi2 2021-10-22 14:20
[讨论] 关于ncverilog 的使用 大卓 2021-9-24 31519 大卓 2021-10-22 14:15
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[求助] 有以下问题,麻烦懂的大佬帮忙看一下,感激不尽 新人帖 放郭 2019-8-16 73571 takeshineshiro 2021-10-21 15:52
悬赏 [求助] 使用X-hdl转换vhdl到verilog时遇到问题 - [已解决] attach_img anpengfei 2021-10-11 62366 anpengfei 2021-10-20 16:54
悬赏 [求助] 如何在原理图中加标记呢? - [阅读权限 255]- [已解决] attach_img 北风1号 2021-10-20 4486 fly_ma 2021-10-20 14:07
[求助] verdi 里的OneTrace 里的trace across hierarchy是什么作用? allright0218 2021-10-20 21777 eaglezhang01 2021-10-20 11:37
[讨论] IC验证 python脚本用哪本书比较好 新人帖 追乐人66 2021-10-14 21738 luojh19960316 2021-10-20 09:52
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