在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜全文
[求助] verilog串转并问题请教 czy619730 2015-12-4 23220 justfigo 2015-12-7 20:55
[求助] Verilog语言问题 zhangxin 2015-11-27 22408 justfigo 2015-12-7 20:52
[求助] 海思,展讯,兆芯,数字IC设计offer该如何选择  ...23 大姐开门啊 2015-10-15 2610283 justfigo 2015-12-7 20:41
[求助] 谁有mentor的calibre软件? etop_ime 2010-11-1 94326 georgejor 2015-12-7 15:50
[求助] ISE14.x的MIG做DDR3控制器  ...2 xmouse 2013-2-22 1815317 chengbaibai 2015-12-7 15:50
[求助] ISE综合VHDL时报错 “Second argument of write must have a constant value” 322512lu 2015-12-7 02787 322512lu 2015-12-7 11:31
[求助] modelsim仿真问题 rice973 2010-5-28 57118 kingkoyan 2015-12-6 22:15
[求助] 关于数字IC设计与FPGA设计的区别  ...23 huikong2013 2014-4-10 2719756 wucaidai 2015-12-6 21:11
[求助] 请教达人帮我看看用verilog写的PWM哪里出错了 crazypo 2014-4-20 74903 cywu 2015-12-6 19:25
[求助] 三相桥式可控整流 ZHANGHUAFENG 2015-12-6 01942 ZHANGHUAFENG 2015-12-6 10:17
[求助] FPGA输出的数据要在时钟下沿输出,需要加什么约束喃? newliujian 2015-12-3 32485 汉白雪玉 2015-12-5 22:27
[原创] FPGA综合 Liz6868 2015-12-5 12712 duweixuan 2015-12-5 17:49
[求助] Xilinx布线 duweixuan 2015-12-5 01598 duweixuan 2015-12-5 17:40
[求助] VIVADO Fft核 流水不能正确 qingmian 2014-12-25 13037 jiaoxiake 2015-12-5 15:23
[求助] 关于FPGA中FFT和IFFT的问题 feiyuzhuxian 2015-12-4 23894 jiaoxiake 2015-12-5 15:13
[求助] zynq从sd卡启动后不能往sd卡上写数据的问题 christine1225 2015-12-3 13833 christine1225 2015-12-5 12:11
[求助] 关于xilinx sdk中c build settings的问题 christine1225 2015-11-18 12462 christine1225 2015-12-5 12:10
[求助] xilinx sdk 层次太深的错误 的解决办法 christine1225 2015-11-17 11359 christine1225 2015-12-5 12:09
[求助] lattice在PAR中出现的error - [悬赏 100 信元资产] tengzuming 2015-12-4 23386 tengzuming 2015-12-4 17:12
[求助] 请教vcs仿真遇到的问题 atlandis 2015-12-4 02333 atlandis 2015-12-4 15:26
[求助] 求助,altera fpga对内部信号直接用内部PLL倍频,该怎么做  ...2 yngfng 2014-3-25 118499 kingkoyan 2015-12-4 10:49
[求助] Verilog编写代码问题,求教!!!  ...2 强力mamada 2015-12-1 134666 曦玄 2015-12-4 10:09
[求助] 哪位大神看看这个FPGA里边电路工作原理是什么样的 dianfengqishi 2015-12-4 01694 dianfengqishi 2015-12-4 08:40
[求助] 求助:RGB转HSI公式用Verilog写的问题? 神奇的海螺 2015-12-3 64419 南宫恨 2015-12-4 07:21
[求助] 新手求助ISE13 问题 wydttjy 2015-12-3 01684 wydttjy 2015-12-3 20:56
[求助] 后端LEF文件中 RECT 后面四个坐标分别指什么? 1027199631 2015-12-3 13041 y295195822 2015-12-3 20:05
[求助] 库文件求助分享 oceanlee 2015-12-3 22786 oceanlee 2015-12-3 17:24
[讨论] Verilog中例化VHDL端口是array类型怎么破? eyeloveu 2015-12-3 02030 eyeloveu 2015-12-3 16:15
[求助] 关于VHDL语言 综合 的一个小问题,求助 坤子 2015-11-5 42505 qianjinliang 2015-12-3 15:43
[求助] 用QSYS生成时只有时钟脚和复位脚?? djqlyy 2014-6-27 34278 shawn1004 2015-12-3 15:06
[求助] 谁有Spaatan6的GTP学习资料 shixiaogang 2015-12-2 32371 mengyuwei290 2015-12-3 14:49
[求助] 关于时钟原语的问题 mengyuwei290 2015-12-2 22782 mengyuwei290 2015-12-3 14:42
[求助] 关于GTX时钟的问题  ...2 mengyuwei290 2015-12-1 137165 mengyuwei290 2015-12-3 14:39
[求助] FPGA如何加速数据中心 chifredhong 2015-11-25 23046 hjj1123 2015-12-3 13:47
[讨论] 建议设立新板块 董小三 2015-12-3 43189 菩提老树 2015-12-3 12:47
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

X

手机版| 小黑屋| 关于我们| 联系我们| 用户协议&隐私声明| 版权投诉通道| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 ) |网站地图

GMT+8, 2025-12-26 19:16 , Processed in 0.047485 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块