lattice在PAR中出现的error

tengzuming · 发表于 2015-12-4 14:38:08

error的提示是这样的：
QQ截图20151204142839.png

PLLInst_0是这个IP：
QQ图片20151204143123.png

pcs_hdmi_10b_inst是这个IP，rxfullclk就是这个IP生成的输出（这个IP就是lattice的PCS）：
QQ截图20151204143522.png

sss08_leon · 发表于 2015-12-4 16:14:23

你这个应该是PLL用的不对，想XILINX的内部时钟加载PLL上需要选择NOBUFFER 应该一个道理吧

tengzuming · 发表于 2015-12-4 17:12:03

本帖最后由 tengzuming 于 2015-12-4 17:13 编辑

回复 2# sss08_leon

谢谢您的回复。其实我现在需要实现的功能就是把hdmi的输入信号转换为lvds。这样的话就需要hdmi rx模块和lvds tx模块，这两个模块lattice本身都有source code，然后我把这两个模块合到一起进行PAR就会出现这样的问题了。
您的意思是要我更换PLL吗？因为这个PLL的选择本身是lattice提供的LVDS模块一部分，所以我也不知道要怎么改成合适的。。

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