数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 31279|排名: 7

版主: yadog, everhappy, chevroletss, shiyinjita, chinafpga, dlb05061131, guofu2010, acgoal, neoitachi, arthur_wang_orz, tangyutao, wanghl_beijing, HADIST

1 ... 27 28 29 303132 33 34 35 ... 894 / 894 页下一页

新窗全部主题最新热门热帖精华更多		作者	回复/查看	最后发表


[解决] ISE 14.7 无法启动：segmentation fault (code dump)	fengbohan1 2022-5-1	23142	fengbohan1 2025-1-4 21:55
[求助] simvision 加载模拟信号加载不进来	Blue_IC 2025-1-4	0682	Blue_IC 2025-1-4 12:48
[讨论] DC综合怎么卡住了	scutlee 2025-1-3	0664	scutlee 2025-1-3 21:56
[求助] DCT综合问题求助	吕归尘 2024-11-19	2953	skysand 2025-1-3 17:50
[讨论] pmic中数字遇到告警时，该如何反应？	nomercy 2024-12-18	1829	Anturze 2025-1-3 16:53
[求助] 遵循Formality用户手册中的Tutorial，为什么Analyze无法实现？	日晨难再 2025-1-3	1719	日晨难再 2025-1-3 15:25
[求助] 请教，芯片內的并列式EEPROM是one port还是dual port？	yungchan 2024-12-19	61066	yungchan 2025-1-3 12:40
[其它] hls设计分享 ...2	sybzq 2024-12-3	131860	JCWANGZI 2025-1-3 10:32
[求助] memory compiler 生成的 lib 的 pg_pin 没有 direction	赫鲁小夫 2024-10-9	91410	赫鲁小夫 2025-1-2 16:19
[讨论] ICG在scan中的问题讨论	Anturze 2022-8-31	53400	cp1995 2025-1-2 16:13
[原创] 滚动截屏软件	tian10 2025-1-2	0606	tian10 2025-1-2 14:37
[求助] 为什么最简单的分频器，也需要一个reset信号?	orientview 2025-1-1	4933	mumei0926 2025-1-1 22:31
[原创] 用Malogic FPGA Board 上的Cy7c68000实现了USB to UART（全速）	dodoee 2023-10-6	32132	dodoee 2025-1-1 16:33
[求助] 数字IC前端设计	山水有相逢 2024-12-3	51228	青枣同学 2025-1-1 16:28
[求助] 请问vcs看波形的dve背景颜色可以改么?	ldy777 2022-9-13	23072	青枣同学 2025-1-1 16:25
[求助] verilog-mode使用时parameter无法替换	mysoul 2021-5-6	53171	青枣同学 2025-1-1 16:22
[求助] 哪里有Genus的flow脚本？	Outerman2000 2023-1-12	11860	cxlisme 2024-12-31 18:01
[求助] 综合设置condition的问题	2441697316 2024-12-30	2857	FGX 2024-12-31 17:25
[求助] 请教低功耗设计中隔离单元的问题	霍无醉 2024-12-31	5838	wxd_rf_zhikun 2024-12-31 17:17
[求助] formality验证中SVF读入 ...2	hzdzkjly 2013-9-26	1518596	CZB的筱 2024-12-31 16:26
[求助] Emacs verilog AUTOINST & parameter问题	sukong123 2016-1-6	24079	cp1995 2024-12-31 15:23
[求助] PCIE DMA原理 - [悬赏 100 信元资产]	buzhou2006 2020-4-7	87105	henry101422 2024-12-31 11:38
[求助] FPGA验证（pipe）pcie	lujigua 2014-10-16	63427	henry101422 2024-12-31 11:25
[求助] 在verilog task 中加入延时输出后波形错误	sktwo 2024-11-20	2746	Patrick0809 2024-12-31 11:19
关于NAND FLASH 控制接口问题的疑问。 ...2	740625 2004-6-4	1710545	leon_strive 2024-12-29 17:01
[原创] 使用DE2-115简单实现CortexM0_DesignStart并Keil调试成功 ...2 3 4 5	Pasingen 2021-7-12	4215623	aaasmart 2024-12-28 18:28
[求助] 16nm数字逻辑综合后最高能运行多少速率？	li859831360 2024-12-27	2845	li859831360 2024-12-28 16:26
[求助] DC综合对SRAM端口的约束问题	2020040401006 2024-12-27	0686	2020040401006 2024-12-27 16:26
[求助] 形式验证-Formality	时间在走人在变 2024-9-26	51443	2596784844 2024-12-27 10:53
Modelsim5.6e的仿真库文件怎么生成，我搞了好几天都没弄出来，救命啊！ ...2	hs157 2003-9-4	119282	cyberwillis 2024-12-26 20:53
[求助] 有人愿意租借solvnet账号2天给我学习吗？有偿求助	海绵宝宝玩电脑 2024-12-26	1972	chuchuang 2024-12-26 14:55
[求助] 大家知道怎么使用spyglass报出特定的两个时钟之间的全部路径吗	独孤败天999 2021-2-26	12070	小兔子宝宝哒 2024-12-26 14:32
[求助] modelsim添加的文件无法编译	chris3_chen 2024-12-23	21404	chris3_chen 2024-12-26 11:59
[讨论] set_multicycle_path会不会存在亚稳态问题？？ ...2 3	Anturze 2024-12-23	202835	Challensys 2024-12-26 11:23
[求助] DC综合时插入门控时钟需不需要制定具体是哪个时钟啊	ZHZIC 2020-10-20	94336	cp1995 2024-12-26 09:54

1 ... 27 28 29 303132 33 34 35 ... 894 / 894 页下一页

返回发新帖

账号		自动登录	找回密码
密码			注册

数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 31279|排名: 7

快速发帖

浏览过的版块

站长推荐 /2