ZYNQ仿真-PS+PL侧全仿如何开展？

hansmmm · 发表于 2017-11-28 11:08:16

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大家好，本人从事FPGA开发，原来接触的FPGA仿真都是纯粹的FPGA(就是现在的纯PL侧)，与其它外设的交互都是自己建立总线模型（bfm）实现。之前用过的仿真手段多是modelsim+debussy或vcs+verdi。现在在学习zynq，尝试使用modelsim+debussy对zynq的PS和PL全仿，但是鼓捣好久也没能成功，现在抛出这个话题，希望有过经历的人给予指导，是不是以后我们只能对PL侧进行仿真，PS侧需要自己建立总线模型？还是怎样一种方式呢？请大家能多多发表意见，十分感谢！！！

hansmmm · 发表于 2017-11-28 11:11:17

先顶一个

bondylep · 发表于 2018-10-9 11:03:11

回复 2# hansmmm

有方案了吗？

wangjun403 · 发表于 2018-10-9 13:51:46

关注！！！！！！

y23angchen · 发表于 2018-10-10 09:35:45

这个问题关注一下，上次试了一下，也没搞定

工大鱼肉 · 发表于 2018-10-10 20:05:54

不知道xilinx给没给PS侧的仿真model，感觉概率不大的

patrick007 · 发表于 2019-1-30 15:11:32

ddr没有vip仿不了。
数据写过去没反应。
数据量不大的话，可以做一个带axi inf的bram模块，把访存行为验证好，axi进到ps之后的行为不用验证，zynq自己应该可以保证。

其他的基本都可以正常仿真。
我们目前是这样，带bd的都在vivado自带的xsim下面仿真。
其他的在modelsim下面，用uvm

也可以考虑整合到一起，但是需要花费一些时间，我们没有尝试。
这里面可能也有一些坑，尤其是bd的东西拿到modelsim里面。
之前尝试过，modelsim报一堆错误，由于不是必须的方案，所以没花时间去debug。

虽然很多地方可以绕路，不过没有vip是有一些受限的。
公司做最好还是买。

huatiantian · 发表于 2022-1-9 17:38:28

very good thx

叶逸昇 · 发表于前天 20:22

请问答主有解决方案了吗

[讨论] ZYNQ仿真-PS+PL侧全仿如何开展？

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