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[讨论] 建议开一个analog layout（版图）的版块 ...2 3 4 5 6..7	jingest 2010-11-10	6028375	ly283571 2011-8-20 02:18
[求助] 怎么将ict格式的文件转换成ASTRO能用的工艺参数？	staceyhoney5 2011-8-19	23490	staceyhoney5 2011-8-19 23:41
[求助] encounter	an835142 2011-8-15	72955	icfbicfb 2011-8-19 21:17
[求助] 用Astro修改天线效应	xiaopangwa 2010-1-28	78148	icfbicfb 2011-8-19 15:47
[求助] 请教：clk和reset信号设为dont touch后还要设置为ideal network么？	staceyhoney5 2011-7-24	45793	icfbicfb 2011-8-19 15:46
[求助] 模块中有一个主时钟clk，由于SRAM是下降沿的，时钟用了!clk	staceyhoney5 2011-8-10	33210	staceyhoney5 2011-8-19 13:30
[求助] [已解决]关于edi导入后的情况	estyzq 2011-8-17	34094	estyzq 2011-8-19 09:37
[求助] [已解决]encounter导入设计的问题	estyzq 2011-8-17	43301	icfbicfb 2011-8-18 23:53
[讨论] 讨论一下clock gating check ，请给与建议	paulszicc 2011-8-17	47440	paulszicc 2011-8-18 16:44
[求助] [已解决]edi导出gds后不能过LVS	estyzq 2011-8-8	89431	estyzq 2011-8-18 16:13
[求助] CTS后clock skew和insertion还算不错，但final route后恶化很多。。。	chris_li 2011-8-16	33954	Andreatong 2011-8-18 10:19
[求助] astro rail 流程	pursuedream 2011-8-17	45571	pursuedream 2011-8-18 09:52
[求助] 评价一个RTL是否属于synthesis/DFT 的关键标准是什么？	czjkk 2011-8-17	12419	icfbicfb 2011-8-17 22:41
[求助] 可以用一个synthesis工具搭建一个CPU吗？	czjkk 2011-8-17	12736	icfbicfb 2011-8-17 22:38
[求助] 有关优化路径组的问题	1359784773 2011-8-16	42797	zhq415758192 2011-8-17 20:53
[原创] encounter Power system user guide	twn2000 2011-8-16	33869	zfx253 2011-8-17 18:42
[求助] 什么是SI effect? 如何fix?	czjkk 2011-8-17	33348	czjkk 2011-8-17 13:51
[求助] func的clock和scan的clock可以是同一个时钟么？	damonzhao 2011-8-9	43463	damonzhao 2011-8-17 11:31
[原创] IO re-assign	twn2000 2011-8-15	53268	twn2000 2011-8-17 11:17
[讨论] 怎样报告这样的路径	chibijia 2011-8-16	13531	陈涛 2011-8-16 22:56
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