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[求助] 后仿真有时钟的概念吗? 新人帖 飘雨的季节65 2023-9-16 2583 gaurson 2023-10-10 17:29
悬赏 [求助] uvm,验证环境怎么通过generate例化多个接口相同但是时钟不同的clocking块 - [悬赏 100 信元资产] yd452133823 2023-10-7 2438 zhangdeshuai 2023-10-10 17:24
[求助] 关于S2IBIS3 的使用 gongsidi@126.co 2014-5-14 23394 shiyuansu 2023-10-10 17:07
[求助] 使用$fsdbAutoSwitchDumpfile设置了波形自动分割后,提示AutoSwitchDumpFile is disabled. attach_img  ...2 qsh123_123 2022-3-7 127127 qsh123_123 2023-10-10 15:04
[求助] 跪求uvm的ip验证大型项目的完整代码  ...2 宋凡 2019-6-12 103077 troyguo1234 2023-10-10 10:46
[求助] UVM 中关于force 用法  ...2 Gavin-35 2023-9-7 101349 liheng369 2023-10-9 19:26
[原创] 断言可以写在verilog的可综合代码中吗 ?  ...2 american007 2019-5-17 117464 炒鸡屈服者 2023-10-8 16:20
[求助] xrun收集代码覆盖率不能出来层次结构 attach_img xiaoxiaoqi 2020-12-18 53261 YLisFine 2023-10-8 13:06
[求助] vcs+upf进行低功耗仿真时软件报错 yuming_ziyi 2023-9-23 3793 shirelee 2023-10-8 09:51
悬赏 [求助] top层例化clk时钟问题 - [已解决] 路过的小怪物 2023-9-22 2485 路过的小怪物 2023-10-7 20:44
[求助] 什么时候用uvm do来启动sequence呢 zhuimeng2020 2023-10-6 0376 zhuimeng2020 2023-10-7 18:09
[原创] c家的IP可以用S家的VIP来验吗?比如说pcie 白黑凤梨 2023-9-27 2579 saipolo 2023-10-7 11:05
[求助] 什么时候用integer数据类型? zhuimeng2020 2023-10-4 0362 zhuimeng2020 2023-10-4 11:42
[求助] system verilog 压缩结构体 新人帖 zlwu 2023-9-25 1435 zhangdeshuai 2023-9-28 14:39
悬赏 [求助] UVM寄存器模型 - [悬赏 10 信元资产] happysingle 2023-9-7 8707 dtyuzhou 2023-9-28 14:33
[求助] system verilog 队列的pop zlwu 2023-9-25 2435 dtyuzhou 2023-9-28 11:41
[求助] run_phase和main_phase可以混用吗? 追乐人66 2023-9-26 3621 dtyuzhou 2023-9-28 11:38
悬赏 [求助] 关于UART验证环境中modem模块端口映射问题 新人帖 - [悬赏 5 信元资产] JEFans 2023-4-26 11002 ICstudent 2023-9-27 18:28
[求助] Cadence Denali PCIe VIP注错方式 新人帖 attach_img HB_Chen 2023-9-26 1500 白黑凤梨 2023-9-27 14:48
[讨论] 模拟IC验证方法学 孙莱维 2023-9-26 4544 孙莱维 2023-9-27 13:28
[求助] 使用vcs仿真UPF时遇到问题 luzi 2022-11-16 11383 多线程维生素 2023-9-27 09:17
[求助] 求助:用nc跑sv和C之间使用open array时出现的问题 oscillator_cn1 2012-3-30 75277 Jt_小舟 2023-9-25 09:52
[求助] shm格式的波形文件如何转成fsdb格式呢 枫舞 2023-9-22 1547 A1985 2023-9-22 22:55
[求助] 跳过某些寄存器复位值检查失败 attach_img 半机器蔡 2022-2-11 41997 Numb233 2023-9-22 17:59
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