你是用VHDL还是用Verilog HDL？

13515102587 · 发表于 2015-10-25 10:47:28

两个都用过啊

darkness2046 · 发表于 2015-10-28 16:09:41

当然是verilog

petrel87 · 发表于 2015-11-2 11:37:14

顶。verilog接近c语言，更容易

白开水水水 · 发表于 2015-11-9 23:58:39

verilog 感觉更易学一些

mengyuwei290 · 发表于 2015-11-26 14:37:48

貌似还是verilog还是用的人多啊。。。

lyfhsd · 发表于 2015-11-26 22:22:16

目前都用

yucaoxilin · 发表于 2015-11-27 08:30:40

VHDL转verilog了……

xaaa · 发表于 2015-11-27 19:38:39

verilog，目前国际上大多数都用verilog，俄罗斯用vhdl比较多。国内早期研究所用的vhdl也比较多。verilog比较灵活；

高瞻forever · 发表于 2015-11-30 09:53:39

个人还是比较喜欢verilog的语言特点，且容易上手！

testi · 发表于 2015-11-30 19:21:12

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