你是用VHDL还是用Verilog HDL？

heuhuirnh · 发表于 2015-9-14 20:17:33

以前用VHDL，现在用verilog。VHDL转verilog没难度，verilog转VHDL需要学习下，虽然用verilog，但是VHDL一些风格我还保留着，VHDL很严谨。

ytpaul · 发表于 2015-9-16 10:42:16

商业EDA工具普遍对Verilog 支持较好，对VHDL支持就不是很给力

supermessi · 发表于 2015-9-16 14:04:59

先接触的VHDL，后来主要用verilog

wayne19910320 · 发表于 2015-9-21 08:26:22

发现本科时候大多学校都教的VHDL，现在上研都是verilog

lw2015 · 发表于 2015-9-22 17:48:40

get money

dada999 · 发表于 2015-9-23 15:43:22

回复 1# buley

VHDL转verilog

hurrywork · 发表于 2015-10-12 16:33:04

老师叫我学verilog

ourkaka · 发表于 2015-10-14 22:07:50

Verilog 这种调查感觉也很久了

haiyi198712 · 发表于 2015-10-16 21:06:55

都用啊

powermm · 发表于 2015-10-21 16:14:12

现在用system verilog

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