在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
[求助] 请问各位大声,nios11老师出现”undifine reference to main“是什么原因啊 attach_img careywang1991 2015-3-10 01529 careywang1991 2015-3-10 12:51
[求助] 【求助】数字IC设计中那些工具平台的选择 chanjoe525 2015-3-9 12152 towardt 2015-3-10 09:31
[求助] 有“求最大值”的ip核吗? VINCENT-XIAO 2015-3-7 43278 glace12123 2015-3-9 23:44
[求助] 关于AXI接口slave模块的时序验证 huanyangyu 2015-3-7 43294 glace12123 2015-3-9 23:38
[求助] Xilinx FPGA的资源报告里的单词都是什么意思?(加红) zhuyuefeng2009 2015-2-28 35718 fj773 2015-3-9 22:38
不错的论文SIGMA DELTA attachment analog_zyl 2007-6-9 32786 jeffej 2015-3-9 22:12
[解决] chipscope 使用问题 liaolianguiq 2010-1-3 69821 坚脑筋 2015-3-9 19:50
[求助] sigma-delta modulator输入直流的问题 attach_img daojianxiaohyf 2012-3-6 23547 jeffej 2015-3-9 16:05
[求助] FPGA中的差分时钟端口是啥意思,为什么说要尽量用差分时钟? unionten 2015-3-3 84435 menghuan313333 2015-3-9 15:53
[求助] system verilog 中copy函数的疑问 myhedwig 2015-3-5 62344 myhedwig 2015-3-9 13:44
[求助] 请各位大神推荐下学时序分析的资料,不胜感激!!!! careywang1991 2015-3-9 01434 careywang1991 2015-3-9 13:26
[求助] XILINX LVDS 国科海天 2014-10-28 63801 黑羽肃霜 2015-3-9 10:35
[求助] 请教一个tsmc 0.18um 工艺工作电压的问题 muzilinvkouyue 2015-3-9 01635 muzilinvkouyue 2015-3-9 09:53
[求助] 假如有delay line的话,综合脚本如何编写 coyboy912 2013-9-27 12958 zhangyuxiebin 2015-3-8 17:50
[求助] (Xilinx)如果某个模块占用了一个3个6输入LUT,那么这三个LUT还能被其他模块调用吗? unionten 2015-3-8 02414 unionten 2015-3-8 15:16
[求助] aurora使用问题 zhch7777 2015-2-28 52949 sq20150307 2015-3-8 09:20
[求助] windows 下有没有和verdi功能相近的工具 gg9132qq 2015-3-7 01890 gg9132qq 2015-3-7 22:47
[求助] 电源抑制比有没有什么简便算法 独孤阳 2014-8-1 32046 evegwell666 2015-3-7 19:43
[资料] GFP成帧的FPGA实现参考资料 attachment duan_dzj 2012-3-18 52864 evegwell666 2015-3-7 19:39
[求助] 请问如何查找ip核? attach_img VINCENT-XIAO 2015-3-6 43028 VINCENT-XIAO 2015-3-7 19:05
[求助] 求关于PSRR方面的论文和资料 独孤阳 2014-8-1 11598 独孤阳 2015-3-6 22:50
[求助] DC综合面积问题 - [阅读权限 255] xiaota 2015-3-6 12313 jacobshen 2015-3-6 22:13
[求助] VCS后仿log lvlingpeng17 2015-3-6 12249 lvlingpeng17 2015-3-6 16:54
[资料] 初学者:MPEG 基础和协议分析指南 attachment debugtcore 2015-2-28 22231 masonson 2015-3-6 15:35
[求助] vivado在impl中报错BUFG不足 schottky163 2015-2-2 55810 liuluren1987 2015-3-6 11:07
[求助] DSP Builder 9.1破解的问题,在线等高手解答 attach_img  ...23 wjfblack 2010-3-17 2913798 xueshizi 2015-3-6 09:56
[求助] 关于fpga仿真的问题 ju610930444 2015-3-3 62886 glace12123 2015-3-6 00:40
[原创] 请教FPGA上如何生成如下两种时钟? attach_img  ...2 atlandis 2015-2-2 104710 418478935 2015-3-6 00:35
[求助] 关于AXI总线VALID和READY信号间的关系  ...2 小鸟探戈 2012-10-8 1317557 glace12123 2015-3-6 00:24
[求助] 请教一些FPGA上PCIE的问题 xlfggg 2015-3-5 21934 xduryan 2015-3-5 22:07
[求助] 请问Xilinx Spartan-6 FPGA SP605价格多少合理? kittysunny 2015-3-5 01322 kittysunny 2015-3-5 12:48
[求助] VCS可以验证FPGA RAMB的INIT初值吗?谢谢 yanpeace 2015-3-5 01555 yanpeace 2015-3-5 10:48
[求助] FIFO 小金豆 2015-3-4 22575 小金豆 2015-3-4 16:31
[求助] hex文件读取 jeer630 2012-10-17 46340 菜鸟小张 2015-3-4 16:07
[求助] fpga新人求教关于时序约束的问题 xiaoyeah 2015-2-26 52420 menghuan313333 2015-3-4 14:19
下一页 »

快速发帖

还可输入 120 个字符
您需要登录后才可以发帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

X

小黑屋| 手机版| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-6-24 21:36 , Processed in 0.044570 second(s), 7 queries , Gzip On, MemCached On.

eetop公众号 创芯大讲堂 创芯人才网
返回顶部 返回版块