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[求助] 用Astro修改天线效应 xiaopangwa 2010-1-28 77825 icfbicfb 2011-8-19 15:47
[求助] 请教：clk和reset信号设为dont touch后还要设置为ideal network么？ staceyhoney5 2011-7-24 45564 icfbicfb 2011-8-19 15:46
[求助] 模块中有一个主时钟clk，由于SRAM是下降沿的，时钟用了!clk staceyhoney5 2011-8-10 33051 staceyhoney5 2011-8-19 13:30
[求助] [已解决]关于edi导入后的情况 estyzq 2011-8-17 33898 estyzq 2011-8-19 09:37
[求助] [已解决]encounter导入设计的问题 estyzq 2011-8-17 43111 icfbicfb 2011-8-18 23:53
[讨论] 讨论一下clock gating check ，请给与建议 paulszicc 2011-8-17 47244 paulszicc 2011-8-18 16:44
[求助] [已解决]edi导出gds后不能过LVS estyzq 2011-8-8 89071 estyzq 2011-8-18 16:13
[求助] CTS后clock skew和insertion还算不错，但final route后恶化很多。。。 chris_li 2011-8-16 33706 Andreatong 2011-8-18 10:19
[求助] astro rail 流程 pursuedream 2011-8-17 45385 pursuedream 2011-8-18 09:52
[求助] 评价一个RTL是否属于synthesis/DFT 的关键标准是什么？ czjkk 2011-8-17 12372 icfbicfb 2011-8-17 22:41
[求助] 可以用一个synthesis工具搭建一个CPU吗？ czjkk 2011-8-17 12609 icfbicfb 2011-8-17 22:38
[求助] 有关优化路径组的问题 1359784773 2011-8-16 42614 zhq415758192 2011-8-17 20:53
[原创] encounter Power system user guide twn2000 2011-8-16 33680 zfx253 2011-8-17 18:42
[求助] 什么是SI effect? 如何fix? czjkk 2011-8-17 33200 czjkk 2011-8-17 13:51
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[原创] IO re-assign twn2000 2011-8-15 53048 twn2000 2011-8-17 11:17
[讨论] 怎样报告这样的路径 attach_img chibijia 2011-8-16 13321 陈涛 2011-8-16 22:56
[求助] 新手提问; 数字版图在做drc时density 出错，该怎么修改啊？ fengxinzhi1987 2011-8-15 43178 fengxinzhi1987 2011-8-16 21:01
[求助] 请教一个问题，版图设计规则中不允许metal90度拐弯，这个如何用drc语句来表达呢？ jiawei2426 2011-8-16 12533 zhq415758192 2011-8-16 19:37
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[求助] ICC powerplan的问题。 henry_wangjj 2011-8-16 02440 henry_wangjj 2011-8-16 13:52
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